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  1. VHDL_infrared_receive

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  2. VHDL程序,实现红外接收,解码,功能可扩展,入门者用
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.13kb
    • 提供者:小猪
  1. infrared_receive

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  2. 接收解码用VHDL语言编写程序,在EDA实验板上实现解码,要求具有以下功能: (a)将一体化红外接收解调器的输出信号解码(12个单击键、6个连续键,单击键编号为7-18,连续键编码为1-6),在EDA实验板上用七段数码管显示出来; (b)当按下遥控器1—6号连续键时,在EDA实验板上用发光二极管点亮作为连续键按下的指示,要求遥控器上连续键接下时指示灯点亮,直到松开按键时才熄灭,用于区别单击键。 (c)EDA实验板上设置四个按键,其功能等同于遥控器上的1—4号按键,当按下此四个按键时七
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:142.53kb
    • 提供者:钟允
  1. tc9012

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  2. 用vhdl编写的实现常用红外遥控芯片(tc9012)解码的程序,调试已通过-Vhdl implementation written in common with the infrared remote control chip (tc9012) decoding process, debugging has passed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:690byte
    • 提供者:郭暧闵
  1. programm-a

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  2. 红外接收后,数码管显示解码实验程序(51单片机)-Infrared receiver, the digital display decoding experimental procedures (51 single)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:12.73kb
    • 提供者:
  1. fdfdf

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  2. 红外解码至1062LCD显示 内含程序和代码-IR decoder to 1062LCD display contains procedures and code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:41.5kb
    • 提供者:su
  1. IR

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  2. FPGA实现的红外IR解码程序,已成功通过Quartus编译,可实现红外正确接收和数据解码提取。-This is a verilog IR decoding program. It has been already compiler through the QuartusII.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.38kb
    • 提供者:水之乡
  1. IR

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  2. 此程序接收红外发射过来的数据,接收解码后由CPU读取,程序运行前将S2都拨到ON.J17短接第一和第二脚。-This program receives the data of the infrared emission over receiving decoded by the CPU to read, before the program runs S2 the appropriated ON.J17 short then the first and second foot.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.51kb
    • 提供者:songjun
  1. hwx

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  2. verilog写的红外遥控解码程序,可通过数码管看按键编码-verilog to write the infrared remote control decoding procedure
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.76kb
    • 提供者:iweimo
  1. class19_IR

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  2. verilog编写的红外解码程序,学习红外的话可以用作参考,已经实际验证过-Verilog prepared by the infrared decoding procedures, learning infrared can be used as a reference, has actually verified
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.82mb
    • 提供者:
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