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  1. Des2Sim

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  2. 本文介绍了一个使用 VHDL 描述计数器的设计、综合、仿真的全过程,作为我这一段 时间自学 FPGA/CPLD 的总结,如果有什么不正确的地方,敬请各位不幸看到这篇文章的 大侠们指正,在此表示感谢。当然,这是一个非常简单的时序逻辑电路实例,主要是详细 描述了一些软件的使用方法。文章中涉及的软件有Synplicity 公司出品的Synplify Pro 7.7.1; Altera 公司出品的 Quartus II 4.2;Mentor Graphics 公司出品的 ModelSim
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.86mb
    • 提供者:黄鹏曾
  1. square-root

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  2. Verilog硬件描述语言能够用软件语言的的方式描述硬件特性,并可用仿真方式完成电路的调试.本文介绍了基于EasyFPGA030的开平方运算器的设计,详细说明了运用verilog语言的设计过程与实现成果。-Verilog hardware descr iption language(HDL)specializes in describing hardware in the way of software language, and complete circuit simulation avai
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:883.52kb
    • 提供者:stella
  1. SOPCVer

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  2. ALtium公司设计软件Altium Designer Summer08设计SOPC系统的详细指导教程,以实例的形式讲解了如何通过该软件设计FPGA系统。-ALtium design software company Altium Designer Summer08 detailed guidance system design SOPC tutorial examples to explain how the form of software design through the FPGA s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:2.34mb
    • 提供者:iyoung
  1. CLOCK-ON-ALTERA-DEV-NOARD-RONTEX

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  2. 这是我上电子线路设计课程时自己写的数字钟设计的整个工程.网上下载安装quartus II软件后双击clock.sof打开调试.若软件说没有权限,请删除db文件夹后再试. 文件夹中附带我的实验报告,其中详细讲解了我的设计思路\软件架构\可能出现的问题等等. 调试步骤就不讲了,管脚分配请网友自行完成. 开发板 Altera Cyclone II EP2C35F672C6 软件平台 Quartus II 语言 verilogHDL-These are all the project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:972.4kb
    • 提供者:needtobestrong
  1. sdr

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  2. 全数字OQPSK解调算法的研究及FPGA实现 论文介绍了OQPSK全数字接收解调原理和基于 软件无线电设计思想的全数字接收机的基本结构,详细阐述了当今OQPSK数字 解调中载波频率同步、载波相位同步、时钟同步和数据帧同步的一些常用算法, 并选择了相应算法构建了三种系统级的实现方案。通过MATLAB对解调方案的 仿真和性能分析,确定了FPGA中的系统实现方案。在此基础上,本文采用Verilog HDL硬件描述语言在Altera公司的QuartusⅡ开发平台上设计
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-05
    • 文件大小:1.54mb
    • 提供者:陈建文
  1. dianziqin

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  2. 详细列举了电子琴的功能和作用,通过VHDL软件设计的方法方真出其结果,对于提高VHDL有很大的帮助-Keyboards list in detail the functions of the software design, the method by VHDL true out its results, party for improving VHDL has very great help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.07mb
    • 提供者:卧虎
  1. mimasuo_design

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  2. 这是一个基于quartusII平台,利用VHDL软件编写的关于密码锁的程序,里面把密码锁详细分解为输入模块、密码模块、控制模块以及一个密码锁的总体设计,详细介绍了密码锁的控制过程。-This is based on quartusII platform, software development using VHDL program on lock, which locks in detail the decomposition of the input module, the cryptogr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.06mb
    • 提供者:kuaileye
  1. plj

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  2. 本设计采用基于FPGA等精度频率设计原理和MCU8051软核做微处理器。采用VHDL语言,成功的编写出了设计程序,并在Qutus II软件环境中,对编写的VHDL程序进行了仿真,得到了很好的效果。最,给出了较详细的设计方法和完整的程序设计以及调试结果。-This design uses FPGA-based design principles and other precision frequency MCU8051 do soft-core microprocessor. Using VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:548.12kb
    • 提供者:zhao
  1. FSM_Mealy

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  2. Mealy型有限状态机设计,设计软件quartus,有详细注释-Mealy type finite state machine design, design software, quartus, with detailed notes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:106.81kb
    • 提供者:wangchenlin2000
  1. FSM_Moore

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  2. Moore型有限状态机设计,设计软件quartus,有详细注释-Moore-type finite state machine design, design software, quartus, with detailed notes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:111.92kb
    • 提供者:wangchenlin2000
  1. DDFSDemo

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  2. DDFS波形发生器设计,设计软件quartus,有详细注释-DDFS waveform generator design, design software, quartus, with detailed notes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:574.25kb
    • 提供者:wangchenlin2000
  1. EDA-shuzizhong

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  2. 用EDA软件实现数字时钟的设计,提供详细的代码-Using EDA software to realize the digital clock design, with detailed code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.02mb
    • 提供者:张静泉
  1. FPGA-chuankoutongxin

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  2. 本文详细介绍了串行通用异步收发器设计原理及调试方法同时还介绍了QuartusII6.0软件的应用,此外还介绍了FPGA实现接口电路设计-This paper introduces the general asynchronous serial transceiver design principle and the debugging method is also introduced QuartusII6.0 software application, in addition, it also
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:350.35kb
    • 提供者:毕LONG
  1. ALTERA-advanced-part-CD-ROM

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  2. 配套光盘提供了书中所有示例的完整工程文件、设计源文件和说明文件。 每个工程示例都包括了该工程的项目文件、源文件、报告文件和生成结果等文件,读者可以用Quartus II或相应的软件直接打开。设计源文件根据设计输入类型分为源代码或原理图等。请读者将设计源文件拷贝到计算机硬盘上,并按照书中的操作步骤自行操作练习。示例说明文件包含了示例的详细信息和操作指南。 通过对本书的学习,读者对图1所示的Altera常用开发工具都有了一定的认识,可以说本书的核心内容就是讨论Altera Quartus I
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:52.87mb
    • 提供者:张程序
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