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搜索资源列表

  1. DEMO1_KEY_LED

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  2. KX_DVP3F型FPGA应用板/开发板(全套)包括:  CycloneII系列FPGA EP2C8Q208C8 40万们,含20M-270MHz锁相环2个。  RS232串行接口;VGA视频口  高速SRAM 512KB。可用于语音处理,NiosII运行等。  配置Flash EPCS2, 10万次烧写周期 。  isp单片机T89S8253:MCS51兼容单片机,12
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:352.27kb
    • 提供者:ldg
  1. LPT.rar

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  2. 实现开漏输出的并口,支持3.3V或5V,支持FPGA 的PS 配置功能。8位配置数据 自动移位输出,输入时钟24MHz,产生1MHz配置时钟。8位CPU数据总线接口, 11位地址总线。支持IO 的置位清除功能。,The realization of open-drain output of the parallel port, support 3.3V or 5V, support for FPGA configuration of the PS function. 8-bit config
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:2.52kb
    • 提供者:tianrongcai
  1. tps75003

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  2. Xinlinx FPGA Spartan3E的供电芯片,提供1.2V,2.5V,3.3V的电源-Xinlinx FPGA Spartan3E power supply chips, to provide 1.2V, 2.5V, 3.3V power supply
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:634.09kb
    • 提供者:
  1. 89S52-control-DDS

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  2. 使用89S52单片机控制AD9854 DDS板产生正弦信号,单片机接口采用5V转3.3V元件74LVC4245-89S52 microcontroller control of AD9854 DDS board to produce a sinusoidal signal, the microcontroller interface, 5V to 3.3V components 74LVC4245
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.26kb
    • 提供者:李金良
  1. TLC1556

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  2. 使用10位串行DA芯片TLC5615将数字信号转换为模拟信号,开发板DA芯片VDD=5V,VREF=3.3V 计算公式:Vout=VREF*(N/1024) N为10位二进制码-Use DA chip TLC5615 10 serial digital signal into an analog signal, the board DA chip VDD = 5V, VREF = 3.3V formula: Vout = VREF* (N/1024) N is 10-bit binary
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:9.93kb
    • 提供者:
  1. DA_TLC5615s-Voltage-on-Digital-tube

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  2. 使用10位串行DA芯片TLC5615将数字信号转换为模拟信号,开发板DA芯片VDD=5V,VREF=3.3V 计算公式:Vout=VREF*(N/1024) N为10位二进制码 最后使用开发板上AD芯片TLC549将电压显示于数码管上-use 10 serial DA TLC5615 and display on digital tube
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.89mb
    • 提供者:作家
  1. DA_TLC5615_breath-led

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  2. 使用10位串行DA芯片TLC5615将数字信号转换为模拟信号,开发板DA芯片VDD=5V,VREF=3.3V 计算公式:Vout=VREF*(N/1024) N为10位二进制码 ** 操作过程:根据需求,在程序改变10位二进制数,在DA芯片的Vout脚输出相应电压-breath led
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:529kb
    • 提供者:作家
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