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  1. CH4CH2CH1VHDL 数字电路参考书所有程序4

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  2. CH2CH1VHDL 数字电路参考书所有程序4-CH2CH1VHDL digital circuit reference all proceedings 4
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:46.49kb
    • 提供者:胡计划
  1. 9.4_PULSE_FRE

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  2. 基于Verilog-HDL的硬件电路的实现 9.4 脉冲频率的测量与显示   9.4.1 脉冲频率的测量原理   9.4.2 频率计的工作原理   9.4.3 频率测量模块的设计与实现   9.4.4 while循环语句的使用方法   9.4.5 门控信号发生模块的设计与实现   9.4.6 频率计的Verilog-HDL描述   9.4.7 频率计的硬件实现 -based on Verilog-HDL hardware Circuit of
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.41kb
    • 提供者:宁宁
  1. 4位基本寄存器的VHDL描述

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  2. 4位基本寄存器的VHDL描述
  3. 所属分类:VHDL编程

  1. verilog fft_64_12

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  2. radix-4,利用cordic算法实现复乘单元
  3. 所属分类:VHDL编程

  1. 生成4种方式的DDS输出的读表程序的VHDL源代码程序

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  2. 生成4种方式的DDS输出的读表程序的VHDL源代码程序.rar
  3. 所属分类:VHDL编程

    • 发布日期:2010-12-02
    • 文件大小:175.93kb
    • 提供者:limiao_0530
  1. 4位7段led程序

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  2. 4位7段led源代码
  3. 所属分类:VHDL编程

  1. 4位7段led灯控制

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  2. 4位7段led灯的控制,0000-9999动态显示
  3. 所属分类:VHDL编程

  1. verilog 128位 突发4. sdr fpga控制器

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  2. verilog 128位 突发4. sdr fpga控制器,verilog 128 bit unexpected 4. sdr fpga controller
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-24
    • 文件大小:117.16kb
    • 提供者:pudnrtest
  1. 4-16

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  2. 4-16译码器。按0000-1111编码,相应的得到输出。下载后可实现-4-16 decoder. Encoded by 0000-1111, the corresponding receive output. Download can be realized
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:47.71kb
    • 提供者:熊熊
  1. 4位乘法累加器

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  2. 4位乘法累加器,有需要的下吧,其他位的可以自行修改~-Multiplication accumulator 4
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-01
    • 文件大小:549byte
    • 提供者:李才
  1. 4bitALU

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  2. 4 bit ALU 设计功能仿真和门级仿真结果 -4 bit ALU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:101.71kb
    • 提供者:吴涵
  1. 2-4

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  2. 2-4译码器 -2-4 decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:950byte
    • 提供者:黄海龙
  1. 8bit_adder_AND_4x4_Multiplier

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  2. 位加法器的verilog程序与4×4 乘法器的verilog描述-Verilog-bit adder of the procedures and 4 × 4 multiplier verilog descr iption! ! !
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:865byte
    • 提供者:mhb
  1. AdderSubtractor

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  2. 4-Bit Adder Subtractor Verilog Code. (Complete project)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:299.38kb
    • 提供者:gunkaragoz
  1. yetert

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  2. This package includes 4-bit calculator designed in Xilinx FPGA 10 using VHDL. This calculator contains 3 registers, 1 ALU, 1 decoder and 1 FSM (finite state machine).
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:448.12kb
    • 提供者:crion
  1. 4bitMultiplier

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  2. 4 bit multiplier implemented with behavioral VHDL code. in addition a visio shceme is attached along with a jpg copy for thoese fho dont have visio.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:132.96kb
    • 提供者:avi
  1. ad9516-4

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  2. ad9516-4芯片的初始化程序,可以方便对各内部寄存器的配置,达到对时钟的分频控制。(the code of ad9516-4 for initial,it can config the register of all through spi interface.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-31
    • 文件大小:2kb
    • 提供者:preman
  1. vivado_license_2016.4

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  2. vivado 2016.4 license
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-06
    • 文件大小:1kb
    • 提供者:wowoqiang
  1. Vivado 2016.4 SRIO License

    1下载:
  2. Vivado 2016.4 SRIO License,已经在Vivado 2016.4 测试通过,可以生产位流。其他版本没有测试,估计也是可以用的(Vivado 2016.4 SRIO License, which has been passed in the Vivado 2016.4 test, can produce a bit stream. The other versions are not tested, and the estimates are also available.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-23
    • 文件大小:3.74mb
    • 提供者:飞翔的雄鹰
  1. 4乘4键盘扫描控制器

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  2. 1. 键值采用16进制编码,即16个按键分别对应显示16进制数 0~F,按键对应关系如下:最上面一行从左至右依次为0~3, 第二行从左至右依次为4~7,第三行从左至右依次为8~B,最 下面一行从左至右依次为C~F,其中b、d显示为小写,其他字 母大写; 2. 按键按下时显示当前键值并保持,直到下一按键被按下时更新 显示; 3. 只有按键被按下时蜂鸣器发出按键音,放开后蜂鸣器不发声。 4. 每个按键对应不同的按键音。(1. The key value is encoded in hexadecim
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-06-13
    • 文件大小:3.29mb
    • 提供者:Minbadly
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