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  1. POC

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  2. 东南大学学生数字系统设计实验:用VHDL语言编写Printer与CPU互连的接口程序-Southeast University students in the experimental digital system design: VHDL language with Printer and CPU interface interconnection procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:714byte
    • 提供者:田华梅
  1. memtest

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  2. 在数字系统中,一般存在多个芯片,利用不同的特点用于实现不同的功能,一般都包含CPU,FPGA,AD,DA,memory,ASSP(专用标准模块),ASIC等。CPU用于进行智能控制,FPGA进行硬件算法处理和多设备接口,AD进行模数转换,DA进行数模转换,memory存储临时数据。因此,FPGA如何与其他芯片进行通讯是重要的设计内容。数据输入,数据输出,双向通讯,指令传递,地址管理,不同时钟的异步通讯问题等等都需要处理。最基本的MEMORY如SRAM(128KX8bbit静态存储器628128)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:218.17kb
    • 提供者:平凡
  1. CPUInterfaceDesignWithVHDL

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  2. 采用VHDL设计的CPU接口电路,源代码-CPU interface circuit, Designed using VHDL。 the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:7.87kb
    • 提供者:
  1. POC

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  2. 该项目是设计和模拟一个并行输出控制器,作为系统总线和打印机之间的接口。-An I/O module is the entity within a computer responsible for the control of one or more external devices and for the exchange of data between those devices and main memory and CPU registers. Thus, the I/O module a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.69mb
    • 提供者:李楠
  1. FPGA-and-cpu

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  2. FPGA与单片机的串行通信接口的程序设计-FPGA and cpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:23.78kb
    • 提供者:周文华
  1. RTL

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  2. 基于fpga的uart设计,包含cpu的接口设计-Fpga-based uart design, including the CPU interface design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:177.3kb
    • 提供者:liaiqin
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