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搜索资源列表

  1. MuxDemux_E1_E3

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  2. E3 -Mux / Demux - Multiplexer of 16 E1 Channels-E3 -Mux / Demux - Multiplexer of 16 E1 Channels

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-02
    • 文件大小：7.03kb
    • 提供者：qi

  1. VHDL_hdb3_decoder

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  2. E1 and E3 line code HDB3 implementation

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-03
    • 文件大小：116.88kb
    • 提供者：林

  1. hdbn

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  2. This “core” is actually two cores – an HDB3/HDB2/B3ZS Encoder that converts NRZ data into P and N pulses according to ITU-T G.703, and a HDB3/HDB2/B3ZS Decoder that converts P and N pulses into NRZ data according to ITU-T G.703. Note: HDB2 and

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-27
    • 文件大小：8.63kb
    • 提供者：fronders
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