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搜索资源列表

  1. state

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  2. 带正负的同频率周期信号的相位差测量机的FPGA实现-With positive and negative periodic signals with frequency phase measuring machine FPGA Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.31kb
    • 提供者:黄茂琴
  1. diwu

    0下载:
  2. 应用VHDL语言编写设计一个正负脉宽可控的4分频的分频器。程序简单易懂;-Application of VHDL language to design a controlled positive and negative pulse frequency divider 4. Procedures are simple and easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:9.51kb
    • 提供者:小杰
  1. di

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  2. 应用VHDL语言编写设计一个正负脉宽可控的4分频的分频器。程序简单易懂;-Application of VHDL language to design a controlled positive and negative pulse frequency divider 4. Procedures are simple and easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:9.51kb
    • 提供者:小杰
  1. SEG_Dynamic

    0下载:
  2. 此实验中,实现了4连体共阴数码管的动态显示。被显示的数据是以2Hz的频率递增的。每个数码管中的小数点也会以2Hz的频率循环点亮。-This experiment, to achieve the 4 piece of negative dynamic digital display. The data is being displayed increasing the frequency of 2Hz. Each LED will take a decimal point in the cycle
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:406.98kb
    • 提供者:王晨
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