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搜索资源列表

  1. RS_decoder

    1下载:
  2. rs编码vvhdl 希望能通过 我不晓得具体对大家有用否 希望懂rs编码的多多交流 -rs coding vvhdl I do not want to be able to know the specific useful whether you want to understand a lot of coding rs exchange
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:15.27kb
    • 提供者:niepan
  1. rs

    2下载:
  2. RS编码,verilog编写,可以自定义多项式,(255,233)和(204,188)均可。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.8kb
    • 提供者:sunwind
  1. rs-5-3

    1下载:
  2. 学习使用FPGA做一些简单的编码器,RS(5,3)编码就是5个字符中有5-3=2两个校正字
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:969.24kb
    • 提供者:rubyshirial
  1. rs_encorder

    0下载:
  2. RS编码的fpga实现,详细的vhdl文档,可以硬件实现。-RS coding fpga implementation, detailed documentation of vhdl can be implemented by hardware.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:4.06kb
    • 提供者:yan
  1. RS-code

    0下载:
  2. 我测试过的!Verilog HDL实现RS编码。-I' ve tested it! RS coding Verilog HDL implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:959.84kb
    • 提供者:kiekie
  1. c23_RS_decoder

    0下载:
  2. 精通verilog HDL语言编程源码9——RS(204,188)译码器的设计-Proficient in verilog HDL source programming language 9- RS (204188) decoder design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:13.14kb
    • 提供者:李平
  1. RS_204_188_decoder

    1下载:
  2. 使用verilog完成了RS编码的设计,编码参数为输入188,输出204-The use of Verilog coding RS completed the design, coding parameters for the importation of 188, the output 204
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-08
    • 文件大小:14.19kb
    • 提供者:小米
  1. rs-codec-8-16

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  2. RS[255,223]纠错码verilog源码,包含编码和解码模块,以及testbench等。-Verilog source code for RS[255,223] encoder and decoder, with testbench included.
  3. 所属分类:VHDL编程

    • 发布日期:2013-05-13
    • 文件大小:26.88kb
    • 提供者:饶进平
  1. rs-codec(255-223)

    1下载:
  2. RS编码是一种纠错码,本程序实现RS(255,223)用FPGA 实现RS编码,程序在Quartus II中调试通过。-RS coding is an error-correcting codes, the procedures for the realization of RS (255,223) with FPGA realization of RS codes, in the Quartus II program through the debugger.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:20.17kb
    • 提供者:yux
  1. rscode

    0下载:
  2. RS编码器在fpga上的实现,用的modelsim开发环境-RS encoder in the realization of the fpga, development environment used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:3.08kb
    • 提供者:wangyujie
  1. rs_encoder

    0下载:
  2. RS编码器的fpga实现,有TESTBench-RS encoder to achieve the fpga, and TESTBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:4.6kb
    • 提供者:王野
  1. RS_ENCODER

    0下载:
  2. DVBC RS编码,标准TS流输入输出接口!-DVBC RS encoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.6kb
    • 提供者:sun mingang
  1. RS-5-3-CODE

    0下载:
  2. RS(5,3)编码器原程序 程序已经调试过 且比较简短-RS(5,3) coder ,this code is very short
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:454.51kb
    • 提供者:ai锋聆
  1. RS

    0下载:
  2. RS编码器的VHDL源程序,程序有点大,不过能用。-RS encoder VHDL source code, program a little big, but can be used.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:875.93kb
    • 提供者:lcz
  1. RS

    0下载:
  2. 基于FPGA的RS编码,包括RS码的编码原理,RS电路的设计与实现-FPGA-based RS code, including the RS, the coding principle, RS Circuit Design and Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.08mb
    • 提供者:陈凯
  1. RS-encode_FPGA

    0下载:
  2. 利用FPGA开发软件 进行rs编码的仿真 模拟RS编码的过程步骤-rs code in FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:138.4kb
    • 提供者:bubble
  1. RS

    0下载:
  2. 通过verilog hdl语言实现RS编码器与译码器的设计-Verilog hdl language through the RS encoder and decoder design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:25.62kb
    • 提供者:李永超
  1. RS(255 239 )编码器 Verilog HDL 实现

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  2. 对于 RS 编码器的设计,常用的编码算法有 2 类,一类是 Berlekamp 算法,另一类是典型编码算法。Berlekamp 算法常用于数据速率要求不是很高的环境下,而典型编码算法具有电路实现结构简洁,占用硬件资源少等优点,因此,采用典型编码算法来实现编码器。
  3. 所属分类:VHDL编程

  1. Reed-Solomon-RS-ENCODE-DECODE

    0下载:
  2. 支持GF(2^n)域的rs编解码,可直接修改参数实现不同方式的RS编码和解码-This program is an encoder/decoder for Reed-Solomon codes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:4.17kb
    • 提供者:songyongbin
  1. fec

    0下载:
  2. RS编码电路 ,包括乘法器的模块和编码部分 RS编码器\mula_0.v RS编码器\mula_1.v RS编码器\rscode.v(The RS encoding circuit includes a multiplier module and an encoding section RS encoder \mula_0.v RS encoder, \mula_1.v, RS encoder, \rscode.v)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:ZJWANG
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