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搜索资源列表

  1. rs-5-3

    1下载:
  2. 学习使用FPGA做一些简单的编码器,RS(5,3)编码就是5个字符中有5-3=2两个校正字
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:969.24kb
    • 提供者:rubyshirial
  1. RSdecoder.rar

    0下载:
  2. cpld/fpga RS(204,188)译码器的verilog程序,cpld/fpga RS (204,188) decoder of the Verilog program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:13.46kb
    • 提供者:陈臣
  1. rs_decoder_31_19_6_latest.tar.

    0下载:
  2. RS解码器的FPGA实现,有TestBench,RS decoder FPGA to achieve, there TestBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:13.2kb
    • 提供者:王野
  1. final_decode

    0下载:
  2. rs解码器在fpga上的实现,采用的modelsim开发平台 -rs on fpga decoder in the realization of the development platform used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:15.75kb
    • 提供者:wangyujie
  1. rs_encorder

    0下载:
  2. RS编码的fpga实现,详细的vhdl文档,可以硬件实现。-RS coding fpga implementation, detailed documentation of vhdl can be implemented by hardware.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:4.06kb
    • 提供者:yan
  1. RS-code

    0下载:
  2. 我测试过的!Verilog HDL实现RS编码。-I' ve tested it! RS coding Verilog HDL implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:959.84kb
    • 提供者:kiekie
  1. uarts

    0下载:
  2. RS-232 interface example for FPGA/EDA developers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.82kb
    • 提供者:jools
  1. rs-codec(255-223)

    1下载:
  2. RS编码是一种纠错码,本程序实现RS(255,223)用FPGA 实现RS编码,程序在Quartus II中调试通过。-RS coding is an error-correcting codes, the procedures for the realization of RS (255,223) with FPGA realization of RS codes, in the Quartus II program through the debugger.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:20.17kb
    • 提供者:yux
  1. rscode

    0下载:
  2. RS编码器在fpga上的实现,用的modelsim开发环境-RS encoder in the realization of the fpga, development environment used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:3.08kb
    • 提供者:wangyujie
  1. rs_encoder

    0下载:
  2. RS编码器的fpga实现,有TESTBench-RS encoder to achieve the fpga, and TESTBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:4.6kb
    • 提供者:王野
  1. rs_5_3_gf256_latest.tar

    0下载:
  2. this paper deal with rs decoder algorithm-this paper deal with rs decoder algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:763.24kb
    • 提供者:Ibrahim
  1. RS

    0下载:
  2. 基于FPGA的RS编码,包括RS码的编码原理,RS电路的设计与实现-FPGA-based RS code, including the RS, the coding principle, RS Circuit Design and Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.08mb
    • 提供者:陈凯
  1. miniuart2

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  2. 用VHDL在CPLD/FPGA上实现与PC机的RS232通信-This UART (Universal Asynchronous Receiver Transmitter) is designed to make an interface between a RS232 line and a wishbone bus, or a microcontroller, or an IP core. It works fine connected to the serial port of a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.47mb
    • 提供者:李涛
  1. rs-232vhdl

    0下载:
  2. it is the code for doing interfacing between computer and fpga board through rs-232.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:911byte
    • 提供者:sundaram
  1. RS-design-on-FPGA

    0下载:
  2. RS算法设计在fpga上的实现文章,很详细-RS design on fpga pdf
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.87mb
    • 提供者:yaoling
  1. RS-encode_FPGA

    0下载:
  2. 利用FPGA开发软件 进行rs编码的仿真 模拟RS编码的过程步骤-rs code in FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:138.4kb
    • 提供者:bubble
  1. RS-232CUART

    0下载:
  2. 主要是利用FPGA进行串口的通信 其中利用到FPGA的开发软件QUARTUS -verilog NIOS UART
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:785.47kb
    • 提供者:李斌
  1. fec

    0下载:
  2. RS编码电路 ,包括乘法器的模块和编码部分 RS编码器\mula_0.v RS编码器\mula_1.v RS编码器\rscode.v(The RS encoding circuit includes a multiplier module and an encoding section RS encoder \mula_0.v RS encoder, \mula_1.v, RS encoder, \rscode.v)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:ZJWANG
  1. rs_code

    1下载:
  2. FPGA实现了RS(255,239)的编译码模块(FPGA implements the RS (255239) encoding and decoding module)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:588kb
    • 提供者:qazmkob
  1. RS

    0下载:
  2. 本文设计了基于FPGA的,用verilog HDL语言描述的在伽罗华域GF( )上的RS(6,4)编码器。在ISE软件上用verilog HDL语言分别对每个模块进行描述,然后在软件上进行编译、仿真,最终实现RS(6,4)编码,下载之后用chipscope采集数据,分析符合仿真结果,达到设计的要求。(This paper is designed based on FPGA, described by Verilog HDL language in Galois field GF () on RS
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:3.68mb
    • 提供者:heyu7892020
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