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  1. DS1307_LCD.通过IIC总线读写实时时钟DS1307

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  2. 通过IIC总线读写实时时钟DS1307,并把时、分、秒显示在12864液晶屏上,用的CycloneII EP2C8,Quartus环境,Through the IIC bus read and write real-time clock, DS1307, and the hours, minutes and seconds displayed on the LCD screen on the 12864, used CycloneII EP2C8, Quartus environment
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-09
    • 文件大小:1.25mb
    • 提供者:iversn
  1. alarm-clock

    0下载:
  2. 基于vhdl的数字闹钟的设计。可实现计时、闹钟、调节时间功能。可以在FPGA上实现。-VHDL-based digital alarm clock design. Can achieve a time, alarm clock, adjust time function. FPGA implementation can be on.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:2.23kb
    • 提供者:tony
  1. The-whole-point-of-time

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  2. 整点报时with流水灯可调时分可调显示星期-The whole point of time with water lights around adjustable adjustable shows a week
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:2.14kb
    • 提供者:蔡宇佳
  1. Lab2b

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  2. A C example for Nios II to use the timer and to obtain the time execution performance
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:904byte
    • 提供者:gios78
  1. stbcmimoofdmnew

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  2. space time block code new
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:21.93kb
    • 提供者:lenin
  1. time

    0下载:
  2. 电子钟实现 包含数字跑表 万年历 设置三个闹钟 时间,日期调整-Clock to achieve with digital stopwatch calendar set three alarm time, date, adjust
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.38kb
    • 提供者:楚辰
  1. FPGA_Based_Real-time_Adaptive_Filtering_for_Space

    0下载:
  2. FPGA Based Real-time Adaptive Filtering for Space Applications
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:307.1kb
    • 提供者:asia
  1. time-counter

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  2. 基于verilog的计时器源代码,可以通过编译-Verilog source code based on the timer, you can compile
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.44mb
    • 提供者:张迪
  1. time

    0下载:
  2. 用单片机及位LED数码管显示时分秒,以及24时的计时方式运行。能够整点提醒(短蜂鸣,次数代表整点时间),使用按键开关可实现时,分调整,秒表/时钟功能转换,省电(关闭显示)及定时设定提醒(蜂鸣器)等功能-With the microcontroller and LED digital tube display minutes and seconds, and 24 hours of run time. Reminded that the whole (short beep, the number
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.41kb
    • 提供者:梁启华
  1. real-time-O-OFDM

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  2. 采用FPGA实现O-OFDM发射于接受的文章,对实时O-OFDM发射机于接收机的的开发有所帮助-FPGA realization of O-OFDM transmitter to accept the article, the real-time O-OFDM transmitter in the development of receiver help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:481.51kb
    • 提供者:k
  1. time

    0下载:
  2. 这是eda时钟,代码,课程设计用。实验。-It is eda time programe.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.19kb
    • 提供者:liyu
  1. time-eda-pro

    0下载:
  2. eda 课程设计,时钟程序。时钟代码.电子时钟。觉悟应有。-It is a eda time programe.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.2kb
    • 提供者:liyu
  1. Time-Sensitive-Control-Flow-Checking-for-Multitas

    0下载:
  2. Time-Sensitive Control-Flow Checking for Multitask Operating System-Based SoCs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:573.8kb
    • 提供者:Eu
  1. 03-Time-Division-Multiplexing

    0下载:
  2. use this for various time division multiplexing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:448.34kb
    • 提供者:Sabz
  1. time-show

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  2. 年月日时分秒的即时显示1234567890-Real-time display of the month, day, hour
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:3.49kb
    • 提供者:哈哈
  1. time

    0下载:
  2. 1S和0.5S时间分频程序,基于EM570,-time for 1Sand 0.5S,for EM570
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:282.38kb
    • 提供者:liu
  1. 4-x-4-on-time-multiplier--table

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  2. 4×4 查找表乘法器 vhdl 语言描述-4 x 4 on time-multiplier look-up table VHDL language describe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:246.81kb
    • 提供者:郭少华
  1. 7-4-linear-space-time-block-codes-

    0下载:
  2. 7-4线性分组码编码器 vhdl描述-7-4 linear space-time block codes encoder vhdl derect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:181.44kb
    • 提供者:郭少华
  1. The-question-of-time-delay

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  2. 关于VHDL的时延问题的若干分析,可以借鉴-The analysie of time delay of Quartus II
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:68.09kb
    • 提供者:三木
  1. time

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  2. fpga万年历 vhdl语言 能实现现实时分秒年月日 及闰年判断 整点报时-every second when the fpga calendar VHDL language can achieve real date and leap year to judge the whole point of time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.89mb
    • 提供者:孙龙飞
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