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搜索资源列表

  1. iic-spi-uart

    0下载:
  2. 基于FPGA的IIC,SPI,UART接口协议的实现。-FPGA-based IIC, SPI, UART interface protocol implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2369447
    • 提供者:Air
  1. uart

    0下载:
  2. verilog 语言,uart 测试程序,通过串口能够测试开发板上uart芯片的好坏-uart test module with verilog langunge,it can be used to test the uart ic on your board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:3542
    • 提供者:chenzhi
  1. uart-code-Verilog

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  2. uart控制器源码-verilog 含源码,测试向量-uart-controller-verilog-code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10539
    • 提供者:李明纬
  1. UART

    0下载:
  2. 用硬件描述语言实现的uart的IPcore,有详细的注释和测试文件-Hardware descr iption language of the H.264 encoder, detailed notes and test files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:22196
    • 提供者:wt
  1. uart

    0下载:
  2. uart IP CORE Verilog quartus-uart IP CORE Verilog quartusii
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:37229
    • 提供者:thegreeneyes
  1. uart-(VHDL)

    0下载:
  2. 利用VHDL语言实现的UART串口通讯,以经过下载验证-the UART program with VHDL as develop language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10829
    • 提供者:艾顺义
  1. UART

    0下载:
  2. Verilog HDL写的实现UART收发程序-Realization of Verilog HDL UART receive written procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:709998
    • 提供者:xiong
  1. UART

    0下载:
  2. This vhdl code has a simple implementation of an UART receiver. This code was generated march 2011 as a universuty project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1521
    • 提供者:plcpe
  1. UART

    0下载:
  2. Verilog编写的UART模块,波特率19200,系统时钟100MHz,x3s50an应用成功-UART module using Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1360
    • 提供者:xhly
  1. FPGA-UART

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  2. 该资料是实现VHDL的串口通信(UART),RS232接口协议,-VHDL implementation of serial communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2088292
    • 提供者:lp
  1. UART

    0下载:
  2. 基于FPGA的UART设计,包含接收模块,发送模块,FIFO模块-UART FPGA-based design, including the receiver module, sending module, FIFO module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:732680
    • 提供者:钱远盼
  1. uart-

    0下载:
  2. 通用异步通讯UART的工程文档,ISE打开工程,里面有VERILOG的源代码,可以编译通过-UART Universal Asynchronous communication engineering documents, ISE open the project, which has VERILOG source code can be compiled
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:30777
    • 提供者:mike
  1. UART

    0下载:
  2. 利用Verilog实现UART收发数据功能-Verilog UART send and receive data functions to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1195901
    • 提供者:高柯
  1. UART

    0下载:
  2. xilinx官网提供的VHDL,UART串行通信模块,肯定好用,官方提供-xilinx official website provides VHDL, UART, FPGA communication module is certainly easy to use, official
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10236
    • 提供者:雪尘
  1. Uart

    1下载:
  2. fpga verilog语言,写的串口通讯,经测试完全没有问题-fpga verilog uart communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1988650
    • 提供者:孙祥龙
  1. UART

    0下载:
  2. uart通用异步收发器,包括收发模块和。数据产生模块-uart transmit and reciver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:985946
    • 提供者:涂强
  1. UART

    0下载:
  2. uart 的verilog源码,希望对大家有用!(UART Verilog source hope useful for all!)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:1024
    • 提供者:qcleo
  1. UART

    1下载:
  2. 自己总结的UART的设计及分析,已在实际工程中应用到,并且带有源代码和仿真代码,总结的文档,非常有用。(My summary of the design and analysis of UART, has been applied in practical engineering, and with source code and simulation code, summary of the document, very useful.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:232448
    • 提供者:何河
  1. UART-HPY

    0下载:
  2. 利用FPGA实现了UART编解码功能,已在Xilinx及Altera多种型号FPGA例化使用。附有寄存器使用说明。(a useful UART decoder and encoder.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:48128
    • 提供者:帕萨迪纳
  1. uart

    0下载:
  2. UART 功能模块,Verilog,简单实用(UART function module, Verilog, simple and practical)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-27
    • 文件大小:1024
    • 提供者:pwy122
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