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搜索资源列表

  1. __FPGA_Prototyping_by_VHDL_Examples

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  2. 在赛灵斯上用VHDL实现,串口,PS MOUSE, PS KEYBOARD..... 协议-on Xilinx,to achieve using VHDL too fullfill UART, PS MOUSE, PS KEYBOARD ..... prototype
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:16910396
    • 提供者:jack
  1. ref3

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  2. nexys 2 vhdl reference project for uart
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:495129
    • 提供者:Mishu
  1. 42cb47db-de04-443e-ac41-d950bce5756a

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  2. vhdl uart代码,自己调试用的,大家指点,支持一下-vhdl uart
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2011
    • 提供者:zengwu
  1. FPGACPLD

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  2. FPGA数字电子系统设计与开发实例导航> 一书的代码,FPGA数字电子系统设计与开发实例导航,用硬件描述语言编写的,I2C,UART,USB,VGA,CAN-BUS,网络等等的书籍配套原代码。。。。使用方法: 1.拷贝到硬盘。 2.用ISE创建项目,分别加入各个代码文件,即可
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:174644
    • 提供者:bbc
  1. sdram32

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  2. DDR SDRAM source verilog source codes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:25220
    • 提供者:sachin
  1. UART_Rcvr

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  2. uart 的源程序,用verilog编写-uart
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1142
    • 提供者:lwq
  1. RD1011_rev01.2

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  2. 采用VHDL实现的UART硬件模块,该模块包括了modem的硬件实现,已经仿真测试代码,顶层模块可以采用VHDL或verilog实现,便于嵌入到自己的设计之中。文档中附有详细的使用说明和注释。-Achieved using VHDL hardware UART module, the module includes the hardware modem has simulation test code modules can be used top-level VHDL or verilog t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:217592
    • 提供者:pd
  1. URAT_vhdl

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  2. URAT VHDL程序与仿真, UART接收器-uart vhdl sample code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:33835
    • 提供者:jz
  1. 87361001Uart2

    0下载:
  2. VHDL语言编写的UART串口通讯,2400Hz的波特率时钟-VHDL language UART serial communication, 2400Hz clock of baud rate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:43732
    • 提供者:火箭强
  1. UART2

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  2. vhdl code for implementation of an UART
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7828
    • 提供者:srikanth
  1. uart_vhdl

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  2. VHDL语言的实现标准的UART串口,并可以多次例化成多串口的-The realization of VHDL language standard UART serial port
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:10358
    • 提供者:刘宏
  1. S5_UART

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  2. verilog编写的UART程序,是红色飓风EP1C6板子上面的程序-this is a UART project with verilog language,it is the programmer by the redlogic s EP1C6 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1746622
    • 提供者:汪东
  1. UART_FPGA_design

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  2. FPGA通用异步收发器设计,代码均在WORD文档里,含详细说明,不错的。-UART FPGA design, the code in the WORD document, the content in detail, good.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:32850
    • 提供者:
  1. usingUART

    0下载:
  2. using uart in fpga.how can use the uart and implemented in spartan-3e development kit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3134
    • 提供者:mamomamo
  1. MCU_FPGA_Interface

    1下载:
  2. msp430单片机用IO口模拟总线时序,与FPGA进行交互的程序,附源代码,verilog,有简单文档。-msp430 I single-chip analog IO bus with timing, with the FPGA interactive process, with the source code, verilog, a simple document.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:870562
    • 提供者:柴佳
  1. UART_LCD

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  2. 基于Actel的Fusion系列FPGA的UART串口,带FIFO-Based on Actel s Fusion Series of FPGA serial UART with FIFO
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:8244
    • 提供者:戚海峰
  1. uart_tx_rx

    0下载:
  2. 该工程用verilog编写,已通过串口调试助手调试通过,接收模块采用8倍波特率采样数据,有较好的滤波功能,在PC上完成自发自收功能。-Verilog prepared by the project, has passed through the serial debug debugging assistant, receiving 8 times the baud rate module sampling data, a better filtering in the PC to complet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1312980
    • 提供者:eric
  1. uartvhdl

    0下载:
  2. 用VHDL语言实现UART的通信协议,可以实现与其他外围设备的通信。-it use vhdl realize the uart,it can help you communicate the to communicate。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:455776
    • 提供者:张峰
  1. UARTReceiver

    0下载:
  2. serial communication using uart FPGA-based embedded system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1249
    • 提供者:hazwaj
  1. i2c_AT24C04_Verilog

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  2. 用Verilog HDL语言编写的AT24C04程序,并用数码管显示,已经过测试,很好用-With the Verilog HDL language of the AT24C04 procedures and use digital tube display, has been tested, very good to use--
  3. 所属分类:VHDL编程

    • 发布日期:2013-11-26
    • 文件大小:11043
    • 提供者:iyandy
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