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搜索资源列表

  1. fft.c

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  2. C语言实现快速傅立叶变换,大家可以参考一下!-C language Fast Fourier Transform, we can take a look!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.14kb
    • 提供者:郭子荣
  1. vhdl

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  2. ldpc编码的vhdl的实现,一种802.13的方式-ldpc coding vhdl implementation, a 802.13 a way
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:5.56kb
    • 提供者:lq
  1. ISE_lab17

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  2. VHDL语言实现正选信号发生器,并仿真验证的源程序及代码-VHDL language is selected signal generator, and simulation and verification of the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.57mb
    • 提供者:kwdx
  1. FirAlgs

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  2. 本代码用C语言实现了有限冲击响应低通滤波器的设计。-The code used C language to implement low-pass finite impulse response filter design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2.75kb
    • 提供者:陈树亮
  1. paper-based-on--radar

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  2. 本文基于某制导雷达信号处理机优化改造工程,介绍了该雷达信号处理机的 接收相干处理(CORP)、动目标显示(MTI)的原理、硬件平台、软件设计、调试以及 优化设计方法。文章首先回顾了该信号处理机相关的信号处理方法,包括数字稳 定校正技术(DS功、参差周期滤波、多次相消器的动目标显示等方法的工作原理和 实现方式,并结合项目进行计算机仿真。其次介绍了信号处理机的组成结构,优 化设计思路,主要功能分配。最后重点讨论了信号处理机的各个模块的工程实现 方法以及数字信号处理
  3. 所属分类:VHDL编程

    • 发布日期:2013-08-09
    • 文件大小:2.86mb
    • 提供者:123
  1. lcd

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  2. 在EDK嵌入式开发中,用C语言实现的LCD显示-EDK embedded in the development, implementation using C language LCD display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.7kb
    • 提供者:yuanjun
  1. jiaotongdeng

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  2. 本程序通过C语言实现交通灯模块,实现交通灯的控制。-The C language program through the traffic light module, the control of traffic lights.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.04kb
    • 提供者:小蔡
  1. FFT

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  2. C语言实现FFT运算的注意(用的是基二时域算法)  且点数是2的n次方-FPGA-based FFT implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:9.32kb
    • 提供者:小强
  1. papers_and-c_code_turbo_by_triangle

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  2. turbo 码的经典文章 ,对于初学者十分有用,另外还包含了BCJR的C语言实现-turbo codes classic article, very useful for beginners, also includes the C language BCJR
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-11-21
    • 文件大小:2.48mb
    • 提供者:triangel
  1. FIR

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  2. FIR滤波器c语言实现,具体的代码放在word中。-FIR filter c language, in the doc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:3.95kb
    • 提供者:wangyou
  1. bch

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  2. 用C语言实现BCH码的编码和译码,译码是用BM迭代算法。-BCH codes in C language coding and decoding, iterative decoding algorithm with BM.
  3. 所属分类:VHDL编程

    • 发布日期:2014-11-09
    • 文件大小:5.81kb
    • 提供者:张刘飘
  1. rs1

    0下载:
  2. 用C语言实现RS的编码和译码,程序简单但是很实惠。-In C of RS encoding and decoding procedures are simple but very affordable.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2.91kb
    • 提供者:张刘飘
  1. VHDL

    0下载:
  2. 滤波器的c语言实现,有较好的验证,能够运行的滤波器C语言-Filter c language, better validation, able to run the filter C language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-12
    • 文件大小:18.95mb
    • 提供者:许震
  1. s1(1)

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  2. c语言实现信号谱的算法 包含fft的c语言实现-FFT for C
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:3.52kb
    • 提供者:Yvone
  1. VGA_CCD531

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  2. 本文围绕一个包含Nios II软核处理器的可编程片上系统展开数码相机的样机设计。论文首先对样机所要达到的整体功能进行了规划,接下来并行开展了软硬件设计。在硬件方面,充分利用了所使用平台提供的SD卡插槽、键盘、数码管、SRAM等各种硬件资源,并用Verilog HDL硬件描述语言设计了样机系统所需要的VGA接口控制器、CMOS图像传感器接口控制器以及VGA显示存储器;在软件方面,本文基于Nios II软核处理器用C语言实现了SD卡的驱动、FAT文件系统的移植、VGA显视器的驱动以及BMP图片文件的
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:14.38mb
    • 提供者:
  1. Lcd_FPGA_NIOS

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  2. 基于NIOS和SOPC builder平台,使用C++语言实现对LCD显示控制。-Based on NIOS and SOPC builder platform to use C++ language to control the LCD display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:3.27kb
    • 提供者:
  1. uart_receive5bytes

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  2. C语言实现CPLD串口接受五个字节,有校验,检验无效不做处理,接续检测接受,注释详细。-C language CPLD five byte serial accept check, test invalid without processing, splice detection to accept detailed notes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:2kb
    • 提供者:杨蕾
  1. C__RSA

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  2. RSA加密算法的C语言实现,可以通过vc6.0的验证-RSA code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:166.83kb
    • 提供者:王喆
  1. CRC

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  2. CRC算法和c语言实现,介绍很详细,不错,可以参考-CRC algorithm and c language, very detail
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:27.1kb
    • 提供者:W
  1. smg_IP

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  2. 在DE 2开发板上,编写vhdl语言,建立8段数码管IP核,在nios ii中编写C语言程序,实现8段数码管数码有规律显示。(In the DE 2 development board, the preparation of VHDL language, the establishment of 8 sections of digital tube IP kernel, in Nios II written in C language program, to achieve the 8 sect
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:9.09mb
    • 提供者:nsl123asd
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