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  1. Chapter10

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  2. 第十章的代码。 本书通过100多个模块实例,详细地讲解了Verilog HDL程序设计语言,全书共分13章,内容涉及VerilogHDL语言基本概念、建模、同步设计、异步设计、功能验证等,实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、SPIMaster Controller、I2C Master controller、CAN ProtocolController、Memory模块、JPEG图像压缩模块、加密模块、ATA控制器、8位RISC-CPU等及各个实例模块相
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-15
    • 文件大小:6.55mb
    • 提供者:xiao
  1. Chapter6-9

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  2. 第六章到第九章的代码 本书通过100多个模块实例,详细地讲解了Verilog HDL程序设计语言,全书共分13章,内容涉及VerilogHDL语言基本概念、建模、同步设计、异步设计、功能验证等,实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、SPIMaster Controller、I2C Master controller、CAN ProtocolController、Memory模块、JPEG图像压缩模块、加密模块、ATA控制器、8位RISC-CPU等及各个实例
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-11
    • 文件大小:5.99mb
    • 提供者:xiao
  1. Chapter11-13

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  2. 第十一章到第十三章的代码 本书通过100多个模块实例,详细地讲解了Verilog HDL程序设计语言,全书共分13章,内容涉及VerilogHDL语言基本概念、建模、同步设计、异步设计、功能验证等,实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、SPIMaster Controller、I2C Master controller、CAN ProtocolController、Memory模块、JPEG图像压缩模块、加密模块、ATA控制器、8位RISC-CPU等及各个
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.85mb
    • 提供者:xiao
  1. 7.1_ImageSmooth

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  2. 基于SystemGenerator的图像平滑处理工程,成功在XilinxFPGA上验证。-The image smoothing based on SystemGenerator the treatment works successfully on the XilinxFPGA verification.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:1.27mb
    • 提供者:Justin Bieber
  1. 7.2_MidFilter

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  2. 基于SystemGenerator的图像中值滤波工程,成功在XilinxFPGA上验证。-Based on SystemGenerator the image median filtering works successfully on the XilinxFPGA verification.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:116.91kb
    • 提供者:Justin Bieber
  1. tengkan-V2.2

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  2. Calculation crosshairs diffraction image at different distances, Channelized receiver based on multi-phase structure, Verification is available.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:148kb
    • 提供者:manjaofienen
  1. niuet

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  2. It comprises aircraft flight attitude control, such as slip angle, tilt angle, roll angle, pitch angle, Complete class-based image processing, contains all of the source code, auto image, Verification is available.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-02
    • 文件大小:146kb
    • 提供者:fieluiten
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