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搜索资源列表

  1. LFSR

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  2. 这是基于FPGA开发板NEXTS3的一个verilog程序,是一个线性反馈移位寄存器LFSR,可用来生成伪随机数-This is based on the FPGA development board NEXTS3 a verilog program, is a linear feedback shift register LFSR, can be used to generate pseudo random Numbers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:859069
    • 提供者:黄志宇
  1. dierci

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  2. 2011年电赛e题信号产生程序 产生10kbit/s -100Kbit/s的m序列 以及一个伪随机序列-M sequence 2011 CEC signal generator generates e title 10kbit/s - 100Kbit/s, and a pseudo-random sequence
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:8398941
    • 提供者:张宏达
  1. M_ACTION1

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  2. 使用fpga实现任意长度,任意方程的伪随机系统码-Using FPGA to achieve arbitrary length, any equation of the pseudo random system code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:420909
    • 提供者:wuxiaoyong
  1. zhitouzi

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  2. 原创。掷骰子游戏,VHDL,quartus,北京邮电大学数电实验,实现随机掷骰子游戏,在数码管显示点数,点阵显示输赢,有开机动画以及开机音乐,可实现多人游戏等-games, VHDL, quartus,experiments of BUPT, pure originality,random game, in the digital display dots, dot matrix display winning or losing, there are boot animation and bo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:11800569
    • 提供者:bamboo
  1. mouse_kit

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  2. 实现难度可调(6级,速度不同)的简单打地鼠游戏。开发板上的led灯代表地鼠,按键代表锤子。此程序代码可直接执行,适合初学者VHDL入门。 源码中,divider为分屏器;key_scan为按键扫描;random产生随机数;music为背景音乐播放模块;manage为主程序模块。-Adjustable implementation difficulty (6 level, different speeds) simple whack-a-mole game.The led lights on
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-08-02
    • 文件大小:1597440
    • 提供者:黄浩洸
  1. m

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  2. 为随机序列产生器,可以作为调制信号的信源-As the random sequence generator, can be used as a modulation signal source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:720
    • 提供者:王佳兴
  1. dice

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  2. This zip file is a complete project which designed a virtual dice randomly. Besides, the random math using 8 registers to give a input to the control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:286317
    • 提供者:zhangyi wang
  1. M_generation

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  2. 伪随机序列发生器,即M序列发生器,VHDL语言完成,已仿真通过。-Pseudo-random sequence generator, VHDL language completed, through simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2301550
    • 提供者:hbxgwjl
  1. FPGA-2048

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  2. 一开始方格内会随机出现2这个小数字,每次可以选择上下左右其中一个方向去滑动,每滑动一次,所有的数字方块都会往滑动的方向靠拢外,系统也会在空白的地方乱数出现一个数字2或4方块,出现2的概率是出现4的概率的3倍,相同数字的方块在靠拢、相撞时会相加。系统给予的数字方块不是2就是4,玩家要想办法在这小小的16格范围中凑出“2048”这个数字方块。断的叠加最终拼凑出2048这个数字就算成功通关。当所有16格数字已满,无法叠加,且没有出现2048这个数字则算游戏失败。-Will randomly appea
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-08
    • 文件大小:6164
    • 提供者:吴国耀
  1. m0_array_Serial_to_parallel

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  2. 采用m序列产生随机序列,然后通过对其进行串转并的转换输出8位,连接AD0832可以观察到噪声。-The m sequence is used to generate random sequence, and then through the serial to turn and the output of 8 bits, the connection of ad0832 can be observed in noise.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:267359
    • 提供者:张琼
  1. random_num

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  2. Random number generation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:852166
    • 提供者:mproject
  1. rc4

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  2. RC4 is the most popular stream cipher in the domain of cryptology. RC4 consist of two algorithms Key Scheduling Algorithm (KSA) and Pseudo-random generation algorithm (PRGA).
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:48858
    • 提供者:varalakshmi
  1. SHIFT4_Parallel-input-serial-output

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  2. 4位串行输入并行输出移位寄存器和移位寄存器产生伪随机序列的源代码以及相关分析-Four serial input and parallel output shift register and shift register of the source code of pseudo-random sequence and correlation analysis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:791330
    • 提供者:FANFAN
  1. pingpang_ram

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  2. 乒乓RAM静态随机存储器的控制,用于解决数据流连续存储问题。-Ping pong RAM static random access control, to solve the problem of continuous data flow storage.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-13
    • 文件大小:2227278
    • 提供者:fengdelong
  1. SRAM

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  2. 静态随机存储器,它是一种具有静止存取功能的内存,不需要刷新电路即能保存它内部存储的数据。-Static random access memory, which is a memory with a static access function, do not need to refresh the circuit that can save its internal storage of data.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-13
    • 文件大小:628736
    • 提供者:马东玉
  1. DDS-pulse-random

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  2. 数字频率计,该代码可用于产生任意频率的脉冲-this code is used to generate pulse
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-12
    • 文件大小:3393
    • 提供者:张旭
  1. CMI

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  2. CMI编码原理图,可以通过对m5随即序列进行编码和解码(CMI is designed for m5 random list, which is should in the project, and it can decode it and get the original m5 list)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:157696
    • 提供者:邵成武
  1. mf081

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  2. Power System Transient Stability Program, can be transient stability, Rapid expansion of random spanning tree algorithm, FMCW frequency modulated continuous wave radar range and angular measurements.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-12
    • 文件大小:5724
    • 提供者:jenglengying
  1. eiush

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  2. Based on multi-document image obtained combining technique, Consider shadow rain attenuation and multipath effects Rapid expansion of random spanning tree algorithm.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-12
    • 文件大小:4816
    • 提供者:lunnanghiupei
  1. rm536

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  2. It can be directly calculated multi-fractal spectrum, Rapid expansion of random spanning tree algorithm, D-S evidence theory data fusion.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:6144
    • 提供者:yeinaigei
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