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搜索资源列表

  1. uvm

    0下载:
  2. the Universal Verification Methodology (UVM) for creating SystemVerilog testbenches.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.78mb
    • 提供者:hugo
  1. uvm-1.1d.tar

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  2. UVM World 官方发布的UVM(通用验证方法学)的源代码,基于SystemVerilog,用于ASIC Verification。2013-03最新发布版本uvm-1.1d.tar.gz-The UVM World official release of the source code of the UVM (Universal Verification Methodology), based on SystemVerilog for ASIC Verification. 2013-03
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:3.07mb
    • 提供者:吴杉
  1. uart2bus_testbench_latest.tar

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  2. uart2bus_testbench,uart测试平台,主要运用uvm验证方法学,对uart接口、systemverilog和uvm等ic开发和验证有一个初步了解和掌握。-Uart2bus_testbench, uart test platform, the main use of uvm validation methodology, uart interface, systemverilog and uvm ic development and verification have a pre
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-15
    • 文件大小:988kb
    • 提供者:徐伟升
  1. AHB2-master

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  2. AMBA AHB 2.0 VIP in SystemVerilog UVM
  3. 所属分类:VHDL编程

    • 发布日期:2021-02-01
    • 文件大小:31kb
    • 提供者:wangliu433
  1. AHB5-master

    1下载:
  2. amba ahb2 协议vip,包括master和slave(AMBA AHB 2.0 VIP in SystemVerilog UVM)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2021-02-01
    • 文件大小:1kb
    • 提供者:wangliu433
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