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  1. CPUdesign

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  2. 计算机组成原理实验多时钟周期CPU设计,包含VHDL代码的设计,实验电路图,实验详细截图。-Computer component experiments designed more CPU clock cycles, including VHDL code design, test circuit, test detailed screenshots.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:11.85mb
    • 提供者:longfu
  1. dds

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  2. dds(9850)测试程序和基本资料,更重要的是又一个能计算频率控制字的软件,具体用法试一下就会做了的,用的是51系列单片机控制的-dds (9850) test procedures and basic information, more importantly, they can calculate a frequency control word of the software, try the specific use will be made, and with the 51 seri
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.87mb
    • 提供者:
  1. fpga

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  2. fpga部分程序实例,包括检测和测试小程序,word版本-fpga some instances, including the testing and test applet, word version
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:105.83kb
    • 提供者:sim
  1. frequency

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  2. 等精度频率计(FPGA部分),通过单片机发送频率控制字给FPGA,FPGA实现计数,再将计数结果发送给单片机后进行数据处理最后发送到数码管或液晶屏显示待测频率-Precision frequency meter (FPGA part) by the single-chip transmit frequency control word to the FPGA, FPGA, to achieve the count, and then finally sent to the digital dat
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:441.44kb
    • 提供者:逸风
  1. lcd

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  2. FPGA对液晶屏写控制字,并在液晶屏上显示一个字符串This is a test -FPGA control word written on the LCD screen, and displayed on the LCD screen a string This is a test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:3.03mb
    • 提供者:mingzhanghui
  1. fadder4

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  2. 例化语句生成的四位全加器代码,写在word里了,也有MODELSIM测试代码-Four cases of full adder codes generated by the statement, written in the word again, and there MODELSIM test code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:8.97kb
    • 提供者:sun
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