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  1. uart_tran

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  2. UART串口的传送verilog原程序,已经经过了编译仿真-Verilog UART serial transmission of the original procedure has been compiled after a simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:262.87kb
    • 提供者:王迪
  1. uart-vhdl-testbench

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  2. simple uart vhdl behavioural model (package) vhdl testbench example
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:1.86kb
    • 提供者:Mark
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