带分频器的bcd计数电路设计，verilog源码-dividers with the bcd count circuit design, Verilog source

该文档提出了一种应用于开关电容流水线模数转换器的CMoS预运放一锁存比较 器．该比较器采用UMC混合／射频0．18肛m 1P6M P衬底双阱CMOS工艺设计，工作电压为 1．8 V．该比较器的灵敏度为0．215 mV，最大失调电压为12 mV，差分输入动态范围为1．8 V，分辨率为8位，在40 M的工作频率下，功耗仅为24．4 ttW．基于0．18 gm工艺的仿真结 果验证了比较器设计的有效性．-A CMOS preamplifier-latch comparator used

基于VHDL语言的EDA秒表作业设计，包括分频、秒表主体和数码管显示译码器，附有工程文件和管脚信息（EDA大作业西电02105143）-VHDL language based the EDA the stopwatch job design, including divide the stopwatch the main digital display decoder, with the project file and pin information (EDA Job Western Elec

本设计的是简易电子琴的实现。采用EDA作为开发工具，VHDL语言为硬件描述语言，quartus II作为程序运行平台，所开发的程序通过调试运行、波形仿真验证，实现了设计目标。本程序使用的硬件描述语言VHDL，可以大大降低了硬件数字系统设计的入门级别。     利用数控分频器设计一个电子琴硬件电路，通过键盘输入使扬声器发出不同频率的声音。-This design is the realization of simple electronic piano. Using EDA a