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Modelsim使用指南
- modelsim的使用指南，帮助大家了解仿真。
SDRAM-Modelsim
- SDRAM读写控制的实现与Modelsim仿真-SDRAM read and write control to achieve with Modelsim Simulation
MCP3202ADC
- VerilogHDL做的关于模数转换芯片MCP3202时序源代码，及其ModelSim仿真文件-VerilogHDL do the analog-to-digital conversion chip MCP3202 timing source code, its ModelSim simulation files
glbl
- FPGA 仿真中经常用到的环境参数设置参考-FPGA modelsim global file
FIFO1
- 给出一个位宽16比特，深度为10的异步FIFO的设计，并要求给出空或满的指示信号。要求用Verilog HDL语言设计，并编写测试激励，以及用Modelsim进行功能仿真，验证设计正确性。10个16位的数据 (FIFO的宽度：也就是英文资料里常看到的THE WIDTH，它指的是FIFO一次读写操作的数据位，就像MCU有8位和16位，ARM 32位等等。FIFO的深度：THE DEEPTH，它指的是FIFO可以存储多少个N位的数据（如果宽度为N）。如一个8位的FIFO，若深度为8，它可以