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clock_VHDL
- VHDL设计的数字时钟,有闹钟、整点报时等功能
DDS_vhdl
- 实现任意小数分频的VHDL源代码,我自己写的,仿真结果是正确的,希望对大家有用!我是打算将400M的时钟分为57.344M
clock
- 多功能电子时钟,具有时间显示,时间调整等功能。-Multi-function electronic clocks, time display, time adjustment functions.
E1_to_e3_v.2.1
- E1信号到E3复用解复用VHDL代码包括时钟合成-E1 to E3 multiplexing & demultiplexing VHDL code, ,including clock synthesis