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  1. reed

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  2. this the completedocumentation and code about reed solomon logic implemented on fpga in verilog.-this is the completedocumentation and code about reed solomon logic implemented on fpga in verilog.
  3. 所属分类:Other systems

    • 发布日期:2017-04-09
    • 文件大小:1.79mb
    • 提供者:kamranmu
  1. sigmadelta_verilog_code

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  2. sigma delta verilog code and testbench for you to do simulation
  3. 所属分类:Other systems

    • 发布日期:2017-04-10
    • 文件大小:910byte
    • 提供者:zhhy3818
  1. 3bit_adder

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  2. Verilog source code for a 3bit full adder build with modules using predefined nand gates.
  3. 所属分类:Other systems

    • 发布日期:2017-04-07
    • 文件大小:650byte
    • 提供者:CRC PUCMG
  1. fsm1

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  2. 序列检测代码verilog 包括tb,已经验证ok-Sequence detection code verilog tb, have verified ok
  3. 所属分类:Other systems

    • 发布日期:2017-11-18
    • 文件大小:1kb
    • 提供者:kai
  1. aaa2

    0下载:
  2. 饮料自动售卖机,售4种不同价格的饮料,verilog代码-Beverage vending machines, sold four different price drinks verilog code
  3. 所属分类:Other systems

    • 发布日期:2017-11-14
    • 文件大小:574byte
    • 提供者:kai
  1. Ver_I2C_eeprom

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  2. 用verilog编写的I2C——E2PROM模型。适用于各种型号的E2PROM,代码内部有参数可选。-Written in verilog I2C- E2PROM model. E2PROM, the internal code applicable to various types of optional parameters.
  3. 所属分类:Other systems

    • 发布日期:2017-11-25
    • 文件大小:656.43kb
    • 提供者:jack
  1. cordic

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  2. it is a code to implement cordic algorithm in verilog. it calculates sin and cosine of an input angle.
  3. 所属分类:Other systems

    • 发布日期:2017-11-23
    • 文件大小:1.77kb
    • 提供者:reena
  1. cordic_iterate

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  2. it is a code for cordic algorithm in verilog. it computes sine and cosine of an angle which is the input. it is iterative structure of cordic.
  3. 所属分类:Other systems

    • 发布日期:2017-11-13
    • 文件大小:1.69kb
    • 提供者:reena
  1. shifter

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  2. VErilog code for the 8 bit shifter
  3. 所属分类:Other systems

    • 发布日期:2017-03-31
    • 文件大小:11.45kb
    • 提供者:pramod
  1. partii_fsm_SequenceUsingCase

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  2. verilog hdl code fsm sequence detector using case ,, an FSM that recognizes two specific sequences of applied input symbols, namely four consecutive 1s or four consecutive 0s. There is an input w and an output z. Whenever w = 1 or w = 0 for fou
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:736.24kb
    • 提供者:shimaa
  1. uvm-1.1d

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  2. uvm 源代码开发,基于此可以实现芯片验证加速和验证充分保证-uvm system verilog based code
  3. 所属分类:Other systems

    • 发布日期:2017-05-14
    • 文件大小:3.53mb
    • 提供者:李辉
  1. SRC

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  2. 4K display verilog HDL source code
  3. 所属分类:Other systems

    • 发布日期:2017-04-08
    • 文件大小:41.39kb
    • 提供者:hyunsik
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