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搜索资源列表

  1. clk_gen

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  2. this is a clock generator program by using concurrent language verilog hdl with xilinx ise.

  3. 所属分类：Compiler program

    • 发布日期：2017-04-16
    • 文件大小：27.71kb
    • 提供者：sagar

  1. verilog-ethernet-master

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  2. Verilog TUTORIAL for beginners. We had earlier published a Verilog tutorial that made use of the Xilinx ISE Simulator.

  3. 所属分类：LabView

    • 发布日期：2017-12-14
    • 文件大小：1.04mb
    • 提供者：kimluan

  1. verilog-image-decompressor-master

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  2. Verilog TUTORIAL for beginners. We had earlier published a Verilog tutorial that made use of the Xilinx ISE Simulator.

  3. 所属分类：LabView

    • 发布日期：2017-12-14
    • 文件大小：1.22mb
    • 提供者：kimluan

  1. verilog-uart-master

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  2. Verilog TUTORIAL for beginners. We had earlier published a Verilog tutorial that made use of the Xilinx ISE Simulator.

  3. 所属分类：LabView

    • 发布日期：2017-12-14
    • 文件大小：56kb
    • 提供者：kimluan

  1. SDRAM-and-FIFO-for-DE1-SoC-master

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  2. Verilog TUTORIAL for beginners. We had earlier published a Verilog tutorial that made use of the Xilinx ISE Simulator.

  3. 所属分类：LabView

    • 发布日期：2017-12-15
    • 文件大小：10.95mb
    • 提供者：kimluan

  1. SRAM

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  2. Verilog TUTORIAL for beginners. We had earlier published a Verilog tutorial that made use of the Xilinx ISE Simulator.

  3. 所属分类：LabView

    • 发布日期：2017-12-17
    • 文件大小：4kb
    • 提供者：kimluan
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