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搜索资源列表

  1. divider_VERILOG

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  2. 采用VERILOG实现硬件除法器。提供RTL代码和仿真文件。-Achieved using VERILOG hardware divider. Provide RTL code and simulation files.

  3. 所属分类：MPI

    • 发布日期：2017-04-03
    • 文件大小：82.51kb
    • 提供者：齐永

  1. pipe_mul

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  2. 移位加乘法器的实现；移位加乘法器的流水线结构的实现。代码清晰明了。-multiply verilog RTL；pipelin multiply verilog RTL；good coding stytle

  3. 所属分类：MPI

    • 发布日期：2017-04-13
    • 文件大小：1.73kb
    • 提供者：mayunli
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