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  1. uart

    1下载：
  2. 基于verilogHDL实现的UART收发，带FIFO缓存。-UART transceiver, with a FIFO buffer.

  3. 所属分类：MiddleWare

    • 发布日期：2016-05-18
    • 文件大小：331776
    • 提供者：张三
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