soc中ip核集成时所采用的一种片上总线，开发的，为opencores所采用，wishbone片上总线指南-were integrated ip nuclear adopted by an on-chip bus, development, for opencores using the on-chip bus wishbone Guide

数字存储器和混合信号超大规模集成电路 本书系统地介绍了数字、存储器和混合信号VLSI系统的测试和可测试性设计。该书是根据作者多年的科研成果和教学实践，结合国际上关注的最新研究热点并参考大量的文献撰写的。全书共分三个部分。第一部分是测试基础，介绍了测试基本概念、测试设备、测试经济学和故障模型。第二部分是测试方法，详细论述了组合和时序电路的测试生成、存储器测试、基于DSP和基于模块的模拟与混合信号测试、延迟测试和IDDQ测试等。第三部分是可测试性设计，包括扫描设计、BIST、边界扫描测试、模拟测

龙芯处理器主要包括三个系列。龙芯1号处理器及其IP系列主要面向嵌入式应用，龙芯2号超标量处理器及其IP系列主要面向桌面应用，龙芯3号多核处理器系列主要面向服务器和高性能机应用。根据应用的需要，其中部分龙芯2号也可以面向部分高端嵌入式应用，部分低端龙芯3号也可以面向部分桌面应用。以后上述三个系列将并行地发展。 龙芯系列处理器通过充分开发指令级并行性、数据级并行性、以及线程级并行性来提高性能。其中龙芯1号系列微处理器实现了带有静态分支预测和阻塞Cache的单发射的乱序执行流水线；龙芯2号系列微处