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DJDPLV_LWB
- 利用超高速硬件描述语言(VHDL)在现场可编程逻辑门阵列(FPGA)上编程实现的纯数字式等精度频率计，不但具有较高的测量精度，而且其测量精度不会随着被测信号频率的降低而下降。为了实现对任意信号进行频率测量，在前端输入加整形电路即可。-use ultra-high-speed Hardware Descr iption Language (VHDL) in field programmable logic gate array (FPGA) series The way to achieve su
EP1C3_12_8_GW481
- 等精度频率计 基于fpga的等精度频率计设计 利用Quartus||进行仿真-And other precision frequency meter fpga based design of equal precision frequency meter using Quartus | | simulation
zhengwen
- 等精度频率计的毕业设计论文 是通过学校严格审查通过的Such as the accuracy of the frequency of graduate design thesis-Such as the accuracy of the frequency of graduate design thesis
VHDL5
- 在电子技术中，频率是最基本的参数之一，又与许多电参量的测量方案、测量结果都有十分密切的关系，因此频率的测量就显得更为重要。测量频率的方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速，以及便于实现测量过程自动化等优点，是频率测量的重要手段之一。在本次毕业设计中我们选择使用单片机来制作数字频率计，并在实际制作中采用了直接测频法。利用延时产生的时基门控信号来控制闸门，通过在单位时间内计数器记录下的脉冲个数计算出输入信号的频率，最终送入LCD中显示。这样制作出来的频率计不仅可以满足设计题
CPLD
- 在电子技术中，频率是最基本的参数之一，又与许多电参量的测量方案、测量结果都有十分密切的关系，因此频率的测量就显得更为重要。测量频率的方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速，以及便于实现测量过程自动化等优点，是频率测量的重要手段之一。在本次毕业设计中我们选择使用单片机来制作数字频率计，并在实际制作中采用了直接测频法。利用延时产生的时基门控信号来控制闸门，通过在单位时间内计数器记录下的脉冲个数计算出输入信号的频率，最终送入LCD中显示。这样制作出来的频率计不仅可以满足设计题
VHDL
- 在电子技术中，频率是最基本的参数之一，又与许多电参量的测量方案、测量结果都有十分密切的关系，因此频率的测量就显得更为重要。测量频率的方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速，以及便于实现测量过程自动化等优点，是频率测量的重要手段之一。在本次毕业设计中我们选择使用单片机来制作数字频率计，并在实际制作中采用了直接测频法。利用延时产生的时基门控信号来控制闸门，通过在单位时间内计数器记录下的脉冲个数计算出输入信号的频率，最终送入LCD中显示。这样制作出来的频率计不仅可以满足设计题
BasedonCPLDFPGAsuchasthefrequencyaccuracyofthedesi
- 基于CPLD／FPGA的可编程逻辑器件，借助单片机AT89C51；利用标准频率50～100MHz的周期信号实现系统计数的等精度测量技术。同时采用闸门测量技术完成脉宽,占空比的测量。-Based on CPLD/FPGA programmable logic devices, with single-chip microcomputer AT89C51 using a standard 50 ~ 100MHz frequency of the periodic signal, such as c
FPGANios_pinlvji
- 基于FPGANios_的等精度频率计设计,采用SOPC设计技术和基于Niosii嵌入式软核处理器的系统设计方案，对传统的等精度测量方法进行了改进-FPGANios_ based on accuracy, such as the frequency of the design, use of technology and SOPC design Niosii based on soft-core processor embedded system design, such as the tradi
dds9851
- 本文主要介绍的是采用直接数字频率合成的短波信号发生器，它主要以微电脑控制部分、直接数字频率合成（DDS）部分、数字锁相环频率合成部分、背光液晶显示部分、功率放大部分等组成。该软件系统采用菜单形式进行操作，操作方便明了，增加了很多功能。它通过启动DDS后，把内存缓存区的数据送到DDS后输出相应的频率，并把数据转换为BCD码，送到液晶显示器进行显示。该系统输出稳定度、精度极高，适用于当代的尖端的通信系统和精密的高精度仪器。-This paper describes the use of direct
vhdl
- 用vhdl实现频率计，提出一种用vhdl实现的等精度测频率系统设计。-Frequency counter using vhdl implementation is presented using vhdl achieve precision measurements such as frequency of system design.
1e8b92c85f98bcaf2e800d3e6adc02ab
- 等精度频率的测试仪，可用于学生数字系统实验的设计参考，以及对频率的等精度测试-And other precision frequency tester, digital systems can be used to test students in reference to the design and testing of the accuracy of the frequency of such
renyiboxing
- 信号发生器是一种常用的仪器，能够实现各种波形，不同频率的输出，电子测试系统的重要部件。本研究 的数字信号发生器足基于直接数字合成即DDS技术设计的，采用VHDL与C语言相结合的方法，通过查找存储 于ROM查找表中的各种标准波形数据，产牛频率Hf调并且高精度的正弦波、方波、锯齿波等常用信号，并且町 以通过修改表中的数据，实现任意信号发生器-Signal generator is a commonly used instrument to achieve a variety of wav
8051_FTEST_K4X4(NO.1)
- 8051_FTEST_K4X4 带按键的4x4的 等精度频率计！-8051_FTEST_K4X4 with key 4x4 and other precision frequency counter!
precision-frequency-meter-design
- 基于51软IP核的等精度频率计设计，利用altera提供的软51ip核，用VHDL语言实现的-Based on 51 soft IP cores, such as precision frequency meter design, the use of the software provided 51ip altera core, using VHDL language
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- 1、 等精度数字频率/相位测试仪是电子通信电路测试设计常需要的一种工具。设计的指标包括，测量频率的范围：（0.1Hz-100MHz），测量精度：測频全域不大于百万分之一。具有脉宽测试功能，相位测试功能。系统的组成框图如下所示，TCLK为待测的信号，BCLK为系统的时钟。其主控制结构如图測频原理所示，采用高速的系统时钟BCLK对待测信号时钟TCLK进行计数，然后计算出一个周期的平均值，最后输出高8位数据。-1, and other precision digital frequency/phase
Precision-frequency
- 等精度频率计设计,含说明文件，设计工程文件-Precision frequency meter design, including documentation, design engineering documents
microcomputer-frequency-meter
- 单片机频率计,等精度测量，能测1HZ到1MHZ，用C语言编写-Single chip microcomputer frequency meter, and other precision measuring, can measure 1 hz to 1 MHZ, written in C language
kese0
- 频率计等精度测量测频测周期测相位 运用Verilog语句 在FPGA(asdsssfdfsdffjtfjtjrtrt)
数字闭环光纤陀螺频率特性分析与测试
- 系统的闭环带宽严重影响光纤陀螺在振动、急转弯等环境条件下的测试精度，闭环光纤陀螺的实际带宽高达几kHz，无法采用一般的角振动台进行全频带频率特性测试，因此，频率特性的分析与测试成为了闭环光纤陀螺研究的一项重要内容。针对这种需求，根据系统的结构框图及工作原理，建立了数字闭环光纤陀螺的动态模型，推导出了系统的传递函数；在此基础上对数字闭环光纤陀螺的频率特性进行了分析，指出了改善系统 动态特性的方法.(The closed loop bandwidth of the system seriously