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当前位置: 首页 资源下载 文档资料 软件工程 搜索资源 - 寄存器 VHDL

搜索资源列表

  1. uart766

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  2. ---实现的部分VHDL 程序如下。   --- elsif clk1x event and clk1x = 1 then ---if std_logic_vector(length_no) >= “0001” and std_logic_vector(length_no) <= “1001” then -----数据帧数据由接收串行数据端移位入接收移位寄存器---rsr(0) <= rxda --- rsr(7 downto 1) <= rsr(6 down
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:153.58kb
    • 提供者:766
  1. VHDL1

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  2. 移位寄存器和9人表决器电路的VHDL设计方案-Shift register people to vote and 9 of VHDL circuit design
  3. 所属分类:Project Design

    • 发布日期:2017-03-28
    • 文件大小:1.33kb
    • 提供者:asd
  1. MCOMMAND

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  2. 微命令寄存器,mcommand对应的vhdl源程序如程序所写-mcommand
  3. 所属分类:software engineering

    • 发布日期:2017-03-28
    • 文件大小:561byte
    • 提供者:李丽
  1. spartan6_fpga_blockram_user_guide

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  2. Spartan6 FPGA中的块存储器使用指南,可以构建为FIFO,ROM,RAM,移位寄存器等。-Spartan6 FPGA block memory in the User Guide, you can build for FIFO, ROM, RAM, shift registers and so on.
  3. 所属分类:software engineering

    • 发布日期:2017-03-30
    • 文件大小:368.09kb
    • 提供者:james
  1. tongREG

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  2. 桶型移位寄存器,用于寄存器的移位,用vhdl编写 -Barrel shift register for shift register, with write vhdl
  3. 所属分类:software engineering

    • 发布日期:2017-04-10
    • 文件大小:606byte
    • 提供者:窦龙
  1. ThedesignofUniversalAsynchronousReceiverTransmitte

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  2. 本课题所设计的UART支持标准的RS.232C传输协议,主要设计有发送模块、接收模块、线路控制与中断仲裁模块、Modem控制模块以及两个独立的数据缓冲区FIFO模块。该模块具有可变的波特率、数据帧长度以及奇偶校验方式,还有多种中断源、中断优先级、较强的抗干扰数据接收能力以及芯片内部自诊断的能力,模块内分开的接收和发送数据缓冲寄存器能实现全双工通信。除此之外最重要的是利用口模块复用技术设计数据缓冲区FIFO,采用两种可选择的数据缓冲模式。这样既可以应用于高速的数据传输环境,也能适合低速的数据传输场
  3. 所属分类:Project Design

    • 发布日期:2017-05-17
    • 文件大小:4.84mb
    • 提供者:mabeibei
  1. jichunqi

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  2. 8位寄存器,quartus2软件下编写的vhdl文件-8-bit register, vhdl language, quartus2 software write down.
  3. 所属分类:software engineering

    • 发布日期:2017-04-29
    • 文件大小:240.82kb
    • 提供者:文诺
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