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搜索资源列表

  1. vgugiolmjm

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  2. 基于CMMB系统的帧同步与符号同步技术的研, 中国CMMB标准少有的论文,-CMMB system based on frame synchronization and symbol synchronization technology research, very few Chinese CMMB standard paper,
  3. 所属分类:software engineering

    • 发布日期:2017-05-04
    • 文件大小:1.37mb
    • 提供者:郑攀峰
  1. 基于FPGA的巴克码发生器与识别器的设计

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  2. 详细介绍了7位巴克码以及帧同步,7位巴克码与帧同步的关系。-Details of the seven Barker code and frame synchronization, 7 Barker code and frame synchronization relationship.
  3. 所属分类:软件工程

    • 发布日期:2013-03-20
    • 文件大小:560.58kb
    • 提供者:杜伟
  1. FPGA

    0下载:
  2. 基于FPGA的数字通信系统帧同步电路设计-FPGA-based digital communication system frame synchronization circuit design
  3. 所属分类:Project Design

    • 发布日期:2017-11-20
    • 文件大小:306.65kb
    • 提供者:kang
  1. on-the-modulation-technology-in-OFDM

    0下载:
  2. 在 OFDM 数学原理和收发模型的基础上,本文对帧同步、定时同步、频率同 步和采样同步给 OFDM 系统所产生的影响进行了理论分析,同时讨论了基于循环 前缀或训练符号的典型 OFDM 同步算法。参考 802.11a 突发数据帧结构和系统参 数,分析几种 OFDM 同步算法用于突发分组传输的性能;在分析了几种经典的信 道估计算法基础上,通过对复杂度和性能的折衷,选择一种适合本文系统的估计 算法。最后作者提出一种改进型 LS 信道估计算法,该算法考虑了 LS 算法中噪声 的影
  3. 所属分类:Project Design

    • 发布日期:2017-11-10
    • 文件大小:8.33mb
    • 提供者:刘金强
  1. DMD-control-board-G4100

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  2. 数字微镜DMD空间光调制器控制平台G4100可以实现如下功能:1、兼容德州仪器TI D4100 开发系统。能够支持1920 X 1080分辨率DMD (DMD微镜为10.6微米,本征分辨率为1920X1080);同时还能支持1024 X 768分辨率的DMD(有两种微镜结构,一种是13.68 微米,对角线长度为0.7 英寸;另一种是10.8 微米的,对角线长度为0.55 英寸); 2、支持USB2.0 高速传输图片和控制信号,具有内同步和外同步功能,同步脉冲电平标准为CMOS 3.3V;
  3. 所属分类:software engineering

    • 发布日期:2017-04-01
    • 文件大小:615.96kb
    • 提供者:刘明
  1. zhen1

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  2. 本文设计的数字分接器是由帧同步提取模块、位同步提取模块、帧同步移位和时序信号恢复模块、分路器模块、串/并转换电路模块五部分组成-Digital tapping machine is designed in this paper by the frame synchronization extraction module, a synchronous extraction module, the displacement of frame synchronization and timing si
  3. 所属分类:software engineering

    • 发布日期:2017-03-27
    • 文件大小:512.13kb
    • 提供者:訚鹏
  1. Offset-CS-Algorithm-in-LTE

    1下载:
  2. :LTE(Long Term Evolution,长期演进)系统中的小区初始搜索过程通过分别检测主同步信号(Primary Synchronization Signal,PSS)和辅同步信号(Secondary Synchronization Signal,SSS)来完成,搜 索结果包括小区组ID、符号定时、频偏估计、组内小区ID以及帧定时[1]。然而,若接收信号   1IDN  2IDN 中存在整数倍频偏,则由于时域的相位旋转,主
  3. 所属分类:Project Design

    • 发布日期:2017-04-28
    • 文件大小:250.8kb
    • 提供者:imc_lte
  1. FPGA_QPSK

    0下载:
  2. 本设计是基于FPGA技术来实现QPSK 数字调制传输系统。通过VHDL语言基于 FLEXlOK芯片完成了QPSK数字调制系统 的调制与解调模块、位同步信号恢复模块、 帧同步信号提取模块,数据采集模块、数据 恢复等模块的设计与仿真。-This design is based on FPGA technology to achieve QPSK Digital modulation transmission system. Based on the VHDL language
  3. 所属分类:Project Design

    • 发布日期:2017-05-04
    • 文件大小:213.02kb
    • 提供者:周能斌
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