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  1. PLLExamples

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  2. 锁相环是指一种电路或者模块,它用于在通信的接收机中,其作用是对接收到的信号进行处理,并从其中提取某个时钟的相位信息。或者说,对于接收到的信号,仿制一个时钟信号,使得这两个信号从某种角度来看是同步的(或者说,相干的)。-received signal processing, and from which a clock extraction phase information
  3. 所属分类:software engineering

    • 发布日期:2017-12-03
    • 文件大小:7.15kb
    • 提供者:李厚儒
  1. FPGA-based-clock-extraction-circuit

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  2. 基于FPGA的时钟提取电路.跳变沿捕捉程序.可控计数器程序-FPGA-based clock extraction circuit. Edge capture process. Controllable counter program
  3. 所属分类:Project Design

    • 发布日期:2017-03-26
    • 文件大小:394.86kb
    • 提供者:张成良
  1. Bitsynchronizationclockprogramdesign

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  2. 一种新型位同步时钟提取方案以及实现。基于的是fpga。-A new bit synchronization clock extraction programs and implementation. Based on the fpga.
  3. 所属分类:Project Design

    • 发布日期:2017-05-11
    • 文件大小:2.06mb
    • 提供者:Bob Wu
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