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  1. cy7c68013工作在SLAVE FIFO下的FPGA源代码

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  2. cy7c68013工作在SLAVE FIFO下的FPGA源代码,已经通过,Verilog编写,cy7c68013 slave fifo mode code ,written by hard ware language
  3. 所属分类:编程文档

    • 发布日期:2014-07-24
    • 文件大小:2.05mb
    • 提供者:杨瑞
  1. UART_spec

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  2. a UART model with FIFO buffer, design with verilog
  3. 所属分类:Communication

    • 发布日期:2017-03-28
    • 文件大小:141.57kb
    • 提供者:quang
  1. Cy7C68013_SLAVE-FIFO_Verilog

    0下载:
  2. 针对CY7C68013在SLAVE FIFO 模式下读写Verilog源代码-For CY7C68013 in the SLAVE FIFO mode to read and write Verilog source code
  3. 所属分类:Communication

    • 发布日期:2017-05-07
    • 文件大小:1.14mb
    • 提供者:王大锤
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