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  1. ALU.zip

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  2. VHDL实现cpu核心逻辑与运算单元模块的实现,完成4bit*4bit输入8bit输出的运算,可做加减乘除逻辑移位6种操作,the implementation of Arithmetic and logic unit based on VHDL, can do as the adder,subtractor,multiplier,divider,shifter and logic operation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:605.45kb
    • 提供者:caolei
  1. AdderSubtractor

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  2. 4-Bit Adder Subtractor Verilog Code. (Complete project)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:299.38kb
    • 提供者:gunkaragoz
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