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搜索资源列表

  1. PIPE_LINING_CPU_TEAM_24

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  2. 采用Quatus II编译环境,使用Verilog HDL语言编写实现了五段流水线CPU。 能够完成以下二十二条指令(均不考虑虚拟地址和Cache,并且默认为小端方式): add rd,rs,rt addu rd,rs,rt addi rt,rs,imm addiu rt,rs,imm sub rd,rs,rt subu rd,rs,rt nor rd,rs,rt xori rt,rs,imm clo rd,rs clz rd,rs slt rd,rs,rt sltu rd,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.72mb
    • 提供者:
  1. DM_RS_PUSCH

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  2. LTE PUSCH参考信号生成,可以参考LTE协议
  3. 所属分类:3G develop

    • 发布日期:2017-03-29
    • 文件大小:587byte
    • 提供者:Chen Qingyong
  1. vbNET OMRON rs232c通信

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  2. Vb.net 與OMRON PLC 通過COM口實現通信 進行DM區域讀寫(Vb.net and OMRON PLC connect)
  3. 所属分类:.net编程

    • 发布日期:2017-12-31
    • 文件大小:80kb
    • 提供者:owenyangmn
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