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搜索资源列表

  1. 抢答器

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  2. 扳动定义为“开始”(即enable)的开关后,一排指示灯变亮,之后抢答开始,有4个扳动开关代表4个抢答器,数码管将显示出最先被扳动的开关的序号,同时发出声音,表示抢答成功。若未按“开始”前,有任意开关被扳动,则数码管显示被扳动开关的序号,并发出另一种声音,表示有人抢答。-reached for the definition of "start" (enable) the switch, a row of bright lights changed, after Respond
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.32kb
    • 提供者:王季红
  1. first4

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  2. 4人抢答器的硬件描述语言设计,可以下载测试与仿真,通过EDA开发系统进行调试-four Responder hardware descr iption language design, test and can be downloaded simulation, EDA through the development of system debugging
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:130.84kb
    • 提供者:sunjiacun
  1. qiangdaqi4ren7.1

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  2. 四人抢答器的实现,主持人按键清除按键,按开始键,100秒倒计时答题时间-four Responder the realization host keys to remove the keys, according to begin key 100 seconds to answer in the countdown time
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:785.46kb
    • 提供者:jerry
  1. VHDLverilogshirenqiangdaqi

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  2. 用VHDL和verilog实现的四人抢答器-using VHDL and verilog realization of four Responder
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-15
    • 文件大小:5.46kb
    • 提供者:qihuolin
  1. Q

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  2. four Responder the realization host keys to remove the keys
  3. 所属分类:其它

    • 发布日期:2008-10-13
    • 文件大小:9.52kb
    • 提供者:lemma
  1. 20041220013871

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  2. MD51-86实现的四人抢答器 -MD51-86 to achieve the four Responder
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:867byte
    • 提供者:杨永斌
  1. answeringdevice

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  2. 四人抢答器,本设计室根据抢答器的原理,用vhdl语言写的。具有很强的实用价值。-Four Responder, this Responder Design Studio, according to the principle, using vhdl language written. Has a strong practical value.
  3. 所属分类:Other systems

    • 发布日期:2017-04-16
    • 文件大小:175.04kb
    • 提供者:红儿
  1. qiangdaqi

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  2. 四人抢答器,已通过编译,仿真,包括抢答识别、计分、计时、数字显示等功能。-Four Responder, has passed the compilation, simulation, including the answer in his identification, scoring, timing and digital display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:2.26kb
    • 提供者:majianhui
  1. qdq

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  2. (1)用于竞赛强大的四人抢答器 (2)抢答开始后20秒倒计,倒计结束后无人抢答显示超时 (3)能显示抢答台号 (4)系统复位后进入抢答状态,能显示犯规警报-(1) is used to contest a powerful four Responder (2) to answer in 20 seconds after the start of countdown, countdown display time-out after no one to answer in (3) ca
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:686.38kb
    • 提供者:
  1. 1

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  2. 四人抢答器,具有一次只识别一个输入信号(即抢答信号),相应之后,再有其他信号输入均不响应。-Four Responder, with time only recognize an input signal (that is, to answer in the signal), corresponding to it, one can not respond to other inputs.
  3. 所属分类:Other systems

    • 发布日期:2017-05-06
    • 文件大小:1mb
    • 提供者:朱婷婷
  1. qiangdaqi-EDA

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  2. 智能抢答器的EDA实现: 1. 四人参赛每人一个按钮,主持人一个,按下就开始; 2. 每人一个发光二极管,抢中者灯亮; 3. 有人抢答时,喇叭响两秒; 4. 抢答时限10秒,从有人抢答开始记时,10秒内不回答问题时喇叭发出两秒声响 -Smart Responder of EDA to achieve: 1. Four entries per person of a button, a moderator, click on Start 2. Each a light-emi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:38.03kb
    • 提供者:xiaoxiao
  1. qdq

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  2. l、设计用于竞赛的四人抢答器,功能如下: (1) 有多路抢答器,台数为四; (2) 具有抢答开始后20秒倒计时,20秒倒计时后无人抢答显示超时,并报警; (3) 能显示超前抢答台号并显示犯规警报; (4) 能显示各路得分,并具有加、减分功能; 2、系统复位后进入抢答状态,当有一路抢答键按下 [qingdaqi.rar] - 四路抢答器,超时报警,提前抢答报警,计分等 -l, designed for race four Responder, functions as follows:
  3. 所属分类:Other systems

    • 发布日期:2017-03-31
    • 文件大小:1.65kb
    • 提供者:杰克
  1. VHDLqiangdaqi

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  2. VHDL四路抢答器该任务分成七个模块进行设计,分别为:抢答器鉴别模块、抢答器计时模块、抢答器记分模块、分频模块、译码模块、数选模块、报警模块,最后是撰写顶层文件。-VHDL four Responder divided into seven modules of the design task, namely: Responder identification module, timing module Responder, Responder scoring module, frequency
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:7.07kb
    • 提供者:oyang
  1. altera_fpga

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  2. 用VHDL编写的四路抢答器,附有加减分功能,答题倒计时等。-Written by VHDL four Responder, with addition and subtraction sub function, answer the countdown and so on.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.03mb
    • 提供者:fengyang
  1. WQM-for-four-people

    0下载:
  2. 四人抢答器课程设计报告...含文档和程序代码-Report of four Responder course design documents and program code with ...
  3. 所属分类:SCM

    • 发布日期:2017-04-10
    • 文件大小:1.17mb
    • 提供者:神话
  1. Four-Responder

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  2. (1)设计用于竞赛抢答的四人抢答器; .有多路抢答,抢答台数为4; .具有抢答开始后20秒倒计时,20秒倒计时后无人抢答显示超时,并报警; .能显示超前抢答台号并显示犯规警报; (2) 系统复位后进入抢答状态,当有一路抢答按键按下,该路抢答信号将其余各路抢答信号封锁,同时铃声想起,直至该路按键松开,显示牌显示该路抢答台号; -(1) is designed to answer in the four competition Responder . More way to an
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:8.74kb
    • 提供者:薛静
  1. 4_channels_-Responder

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  2. 基于Verilog HDL语言的四路抢答器,仿真过,程序能正常运行-Four Responder based on Verilog HDL language,it has been tested and can normally run.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:4.53kb
    • 提供者:徐小明
  1. four--respongder

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  2. 四位抢答器,当某个人想要进行答题时,及时按下按键,抢答成功-Four Responder, when someone wants to answer in a timely manner to press the button, answer
  3. 所属分类:SCM

    • 发布日期:2017-11-27
    • 文件大小:686byte
    • 提供者:李淼
  1. VHDL-design-four-Responder

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  2. 1、熟悉四人抢答器的工作原理。 2、加深对VHDL语言的理解。 3、掌握EDA开发的基本流程。 -A familiar four Responder works. 2, to deepen the understanding of the VHDL language. 3, master EDA development of the basic processes.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:1.13mb
    • 提供者:于治成
  1. Four-quiz-Responder

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  2. 运用VHDL语言实现四路智力竞赛抢答器。抢答器的主要功能模块是是:1、对第一抢答信号的鉴别和锁存功能;2、计分功能。3、数码显示  ;4、答题限时功能。在本设计主要讲述抢答、计分和警告的功能。-Using VHDL language quiz four Responder.Responder main function modules are: 1, for the first answer to identify and latch signal 2, scoring functio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:257.44kb
    • 提供者:YCZ
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