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搜索资源列表

  1. CA-vfdl

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  2. GPS C/A码 发生器 LFSR 源代码 VHDL 语言-GPS C / A code generator LFSR VHDL source code
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:1.12kb
    • 提供者:wuhao
  1. 伪随机序列

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  2. 线形反馈移位寄存器(LFSR)是数字系统中一个重要的结构,本程序可以自动产生AHDL,VHDL,Verilog的源代码及电路原理图。程序可以运行在win98/2000/NT平台-linear feedback shift register (LFSR) digital system is an important structure, the process can be automatically generated AHDL, VHDL, Verilog source code and ci
  3. 所属分类:通讯编程

    • 发布日期:2008-10-13
    • 文件大小:159.28kb
    • 提供者:夏沫
  1. LFSR

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  2. verilog实现的8阶伪随机序列发生器,文件包含了三种主要模块:控制模块,ROM模块,线性反馈移位寄存器(LFSR)模块。已经通过modelsim仿真验证。-verilog to achieve 8-order pseudo-random sequence generator, the file contains three main modules: control module, ROM modules, a linear feedback shift register (LFSR) mo
  3. 所属分类:Windows Develop

    • 发布日期:2017-03-23
    • 文件大小:849.94kb
    • 提供者:风影
  1. profiles

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  2. source code of counter,ram,lfsr etc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.21kb
    • 提供者:narsimha
  1. LFSR

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  2. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.22kb
    • 提供者:Viral
  1. 13105886-vhdl-lab-programs

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  2. vhdl programme on lfsr
  3. 所属分类:Project Design

    • 发布日期:2017-04-25
    • 文件大小:283.46kb
    • 提供者:rahul
  1. LFSR

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  2. LFSR模块,单个模块,实现移位寄存器,生成测试用pattern-LFSR
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:2.33kb
    • 提供者:henin
  1. cdma

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  2. vhdl code for flip-flop,lfsr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:102.21kb
    • 提供者:sandeep
  1. BIST

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  2. A simple BIST in VHDL. It contains a LFSR with an SISR.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:396.17kb
    • 提供者:bommeren
  1. VHDL

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  2. For the animal file: we built a system that took in a UAC code and output if the animals need vaccines and if we are in danger of being eaten Seven_segment Clock_Design : built a clock State_machine: RoboRacer game (r9-bit LFSR) For the Elev
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.7mb
    • 提供者:Michael Ng
  1. CRC-Parallel-Computation

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  2. 用软件实现CRC校验码计算很难满足高速数据通信的要求, 基于硬件的实现方法中, 有串行经典算法LFSR,电路以及由软件算法推导出来的其它各种并行计算方法。以经典的LFSR,电路为基础, 研究了按字节并行计算CRC校验码的原理.-Implemented in software CRC checksum calculation is difficult to meet the requirements of high-speed data communications, hardware-based
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:200.79kb
    • 提供者:Geer
  1. lfsr

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  2. the LFSR is coded in VHDL, using a structural descr iption, which is instantiated as a separate component in the top-level design. Then we can get a random number by a pseudorandom number generator based on a linear feedback shift register (LFS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:1.68kb
    • 提供者:宋臣
  1. LFSR

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  2. practical example using verilog and vhdl by xilinx
  3. 所属分类:Communication

    • 发布日期:2017-05-02
    • 文件大小:834.32kb
    • 提供者:ali
  1. LFSR

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  2. Linear-feedback shift register vhdl code
  3. 所属分类:Other systems

    • 发布日期:2017-05-05
    • 文件大小:25.1kb
    • 提供者:mahdi
  1. LFSR

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  2. lfsr vhdl code ise matlab
  3. 所属分类:其他

    • 发布日期:2017-12-22
    • 文件大小:402kb
    • 提供者:masoudu
  1. vhdl_rand

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  2. Linear Feedback Shift Register (LFSR)/Random number generator
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-01
    • 文件大小:111kb
    • 提供者:sheldon01
  1. LFSR

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  2. lfsr vhdl code by hamid ghanbari
  3. 所属分类:其他

    • 发布日期:2018-01-03
    • 文件大小:12kb
    • 提供者:ghanbari1995
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