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搜索资源列表

  1. rs-5-3

    1下载:
  2. 学习使用FPGA做一些简单的编码器,RS(5,3)编码就是5个字符中有5-3=2两个校正字
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:969.24kb
    • 提供者:rubyshirial
  1. RSdecoder.rar

    0下载:
  2. cpld/fpga RS(204,188)译码器的verilog程序,cpld/fpga RS (204,188) decoder of the Verilog program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:13.46kb
    • 提供者:陈臣
  1. rs_decoder_31_19_6_latest.tar.

    0下载:
  2. RS解码器的FPGA实现,有TestBench,RS decoder FPGA to achieve, there TestBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:13.2kb
    • 提供者:王野
  1. final_decode

    0下载:
  2. rs解码器在fpga上的实现,采用的modelsim开发平台 -rs on fpga decoder in the realization of the development platform used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:15.75kb
    • 提供者:wangyujie
  1. learn_RS_coding

    1下载:
  2. 自己根据网上已有程序改写的(127,115)RS编码,有详细的注释及对FPGA实现算法的改写(参考try123.m),希望可以让大家少走弯路-(127,115) rs encoder/decorder with detailed annotations.
  3. 所属分类:matlab

    • 发布日期:2016-03-31
    • 文件大小:49.58kb
    • 提供者:yan
  1. rs_encorder

    0下载:
  2. RS编码的fpga实现,详细的vhdl文档,可以硬件实现。-RS coding fpga implementation, detailed documentation of vhdl can be implemented by hardware.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:4.06kb
    • 提供者:yan
  1. RS-code

    0下载:
  2. 我测试过的!Verilog HDL实现RS编码。-I' ve tested it! RS coding Verilog HDL implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:959.84kb
    • 提供者:kiekie
  1. rs

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  2. rs编解码,对实现了rs码的编解码,并对其误码率进行了分析仿真-rs codec, to the achievement of the rs code coding and decoding, and BER analysis simulation
  3. 所属分类:Communication-Mobile

    • 发布日期:2015-07-12
    • 文件大小:1.75kb
    • 提供者:qibo
  1. uarts

    0下载:
  2. RS-232 interface example for FPGA/EDA developers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.82kb
    • 提供者:jools
  1. rs-codec(255-223)

    1下载:
  2. RS编码是一种纠错码,本程序实现RS(255,223)用FPGA 实现RS编码,程序在Quartus II中调试通过。-RS coding is an error-correcting codes, the procedures for the realization of RS (255,223) with FPGA realization of RS codes, in the Quartus II program through the debugger.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:20.17kb
    • 提供者:yux
  1. RS_Verilog

    0下载:
  2. RS码的FPGA实现,verilog语言形式,好参考资料-FPGA realization of RS code, verilog language form, a good reference
  3. 所属分类:Communication-Mobile

    • 发布日期:2017-03-29
    • 文件大小:98.88kb
    • 提供者:张洪
  1. rscode

    0下载:
  2. RS编码器在fpga上的实现,用的modelsim开发环境-RS encoder in the realization of the fpga, development environment used in modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:3.08kb
    • 提供者:wangyujie
  1. rs_encoder

    0下载:
  2. RS编码器的fpga实现,有TESTBench-RS encoder to achieve the fpga, and TESTBench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-03-31
    • 文件大小:4.6kb
    • 提供者:王野
  1. rs_5_3_gf256_latest.tar

    0下载:
  2. this paper deal with rs decoder algorithm-this paper deal with rs decoder algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:763.24kb
    • 提供者:Ibrahim
  1. RS-decode_base-on-FPGA

    0下载:
  2. 这是一篇很精彩的硕士论文,里面详细论述了RS编译码的原理和实现方法,值得下载-This is a wonderful master rs decode thesis, which discusses in detail the RS encoding and decoding of the principle and method, it is worth to download! ! !
  3. 所属分类:Communication

    • 发布日期:2017-05-13
    • 文件大小:3.23mb
    • 提供者:刘伟
  1. RS3123

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  2. Reed- So lomon (RS) 码是一种重要的纠错码, 它对随机性和突发性错误有极强的纠错能力, 广泛应用于 数字视频广播(DVB) 系统和其它数字通信领域。给出了一种GF (25) 域上的RS (31, 23) 编码器的实现算法, 介绍 了用现场可编程门阵列(FPGA ) 实现RS 编码器的原理和过程, 并给出了实现电路及其仿真的输出波形。-Reed-So lomon (RS) code is an important error-correcting code, its ra
  3. 所属分类:Communication

    • 发布日期:2016-03-31
    • 文件大小:352kb
    • 提供者:王彬
  1. RS

    0下载:
  2. 基于FPGA的RS编码,包括RS码的编码原理,RS电路的设计与实现-FPGA-based RS code, including the RS, the coding principle, RS Circuit Design and Implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.08mb
    • 提供者:陈凯
  1. rs-232vhdl

    0下载:
  2. it is the code for doing interfacing between computer and fpga board through rs-232.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:911byte
    • 提供者:sundaram
  1. fec

    0下载:
  2. RS编码电路 ,包括乘法器的模块和编码部分 RS编码器\mula_0.v RS编码器\mula_1.v RS编码器\rscode.v(The RS encoding circuit includes a multiplier module and an encoding section RS encoder \mula_0.v RS encoder, \mula_1.v, RS encoder, \rscode.v)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:1kb
    • 提供者:ZJWANG
  1. 基于FPGA的串口通信系统

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  2. 该设计是基于 FPGA 的串口通信系统模拟仿真,通过对 RS-232 串行总线 接口的设计,掌握发送与接收电路的基本思路,并进行串口通信。采用 Verilog HDL 语言对 UART 波特率产生模块、数据发送模块、接收模块进行硬件描述, 再将其整合为一个 RS-232 收发模块,最终在顶层模块中将两个 RS-232 模块例 化,实现两块 FPGA 芯片全双工通信的设计。(Design of serial communication system based on FPGA)
  3. 所属分类:文章/文档

    • 发布日期:2017-12-19
    • 文件大小:565kb
    • 提供者:小可大本
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