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搜索资源 - VHDL key expansion
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AES decoder aes_dec.vhdl
AES encoder aes_enc.vhdl
Package used by rest of design aes_pkg.vhdl
Key Expansion component for AES encoder and decoder key_expansion.vhdl
-AES AES encoder decoder aes_dec.vhdl aes_ enc.vhdl Package used by rest
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Consecutive AES core
Descr iption of project..
Features
- AES encoder
- 128/192/256 bit
- AES decoder
- 128/192/256 bit
Status
- Key Expansion added
- Encoder added
- Decoder added
- Documentation added
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rc5 key expansion algorithm implementation in vhdl, using state machine too. use ieee papers for more detailed descr iption
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key expansion code for vhdl in advanced encryption standard
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基于FPGA设计的电子密码锁是一个小型的数字系统，与普通机械锁相比，具有许多独特的优点：保密性好，防盗性强，可以不用钥匙，记住密码即可开锁等。目前使用的电子密码锁大部分是基于单片机技术，以单片机为主要器件。在实际应用中，程序容易跑飞，系统的可靠性较差。本文介绍的一种基于现场可编辑门阵列FPGA器件的电子密码锁的设计方法，采用VHDL语言对系统进行描述，并在EP3C10E144C8上实现。
通过仿真调试，利用可编程逻辑器件FPGA的电子密码锁的设计基本达到了预期目的。当然，该系统在一些细节
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