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搜索资源列表

  1. HDB3byVHDL

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  2. 基于VHDL语言的HDB3码编译码器的设计 HDB3 码的全称是三阶高密度双极性码,它是数字基带传输中的一种重要码型,具有频谱中无直流分量、能量集中、提取位同步信息方便等优点。HDB3 码是在AMI码(极性交替转换码)的基础上发展起来的,解决了AMI码在连0码过多时同步提取困难的问题
  3. 所属分类:中间件编程

    • 发布日期:2008-10-13
    • 文件大小:250.96kb
    • 提供者:liangtao
  1. 各种码型变换

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  2. 基于vhdl语言的各种码型变换,包括AMI、HDB3、CMI BPH、RZ、BNRZ等。
  3. 所属分类:通讯编程

    • 发布日期:2010-12-24
    • 文件大小:2.27kb
    • 提供者:guowenting
  1. cmi

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  2. CMI/AMI编码解码模块 VHDL源代码-CMI/AMI编码解码 VHDL源代码
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:68.37kb
    • 提供者:tomyang
  1. HDB3encoder

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  2. 数字基带信号的传输是数字通信系统的重要组成部分。在数字通信中,有些场合可不经过载波调制和解调过程,而对基带信号进行直接传输。采用AMI码的信号交替反转,有可能出现四连零现象,这不利于接收端的定时信号提取。而HDB3码因其无直流成份、低频成份少和连0个数最多不超过三个等特点,而对定时信号的恢复十分有利,并已成为CCITT协会推荐使用的基带传输码型之一。为此,本文利用VHDL语言对数据传输系统中的HDB3编码器进行了设计。-Digital baseband signal transmission i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:105.94kb
    • 提供者:shashou
  1. ami

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  2. ami编解码程序,用VHDL语言编写的,仅供参考-AMI encode decode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.63kb
    • 提供者:杨杨
  1. hdb

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  2. 数字基带信号的传输是数字通信系统的重要组成部分。在数字通信中,有些场合可不经过载波调制和解调过程,而对基带信号进行直接传输。采用AMI码的信号交替反转,有可能出现四连零现象,这不利于接收端的定时信号提取。而HDB3码因其无直流成份、低频成份少和连0个数最多不超过三个等特点,而对定时信号的恢复十分有利,并已成为CCITT协会推荐使用的基带传输码型之一。为此,本文利用VHDL语言对数据传输系统中的HDB3编码器进行了设计。 基于达到达到达到的信号发生器的源程序-Digital baseband
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:2.86kb
    • 提供者:成风
  1. hdb3_codedecode

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  2. 用VERILOG实现的,hdb3编码器和解码器,经过前仿真和后仿真成功-Achieved with the VERILOG, hdb3 encoder and decoder, after a successful pre-simulation and post simulation
  3. 所属分类:VHDL编程

    • 发布日期:2013-03-05
    • 文件大小:424.78kb
    • 提供者:Along
  1. AMI_HDB3

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  2. VHDL实现AMI码和HDB3码之间的相互转换,编译环境为Quartus II 6.1-HDB3 AMI code and VHDL code to achieve conversion between, the build environment for the Quartus II 6.1
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:47kb
    • 提供者:冯进伟
  1. EDA

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  2. 本设计是在Quartus ii开发环境下采用VHDL语言实现的AMI/HDB3编码器课程设计。(This design is a course design of AMI / HDB3 encoder implemented by VHDL language in the development environment of Quartus II.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-08-31
    • 文件大小:1.83mb
    • 提供者:Z Yu
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