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  1. uartverilog

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  2. FPGA利用串口、FIFO实现串口收发数据(FPGA using serial port, FIFO serial transceiver data)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-23
    • 文件大小：192kb
    • 提供者：mzl127
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