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搜索资源列表

  1. 8x8IDCT

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  2. 8x8 iDCT verilog code 一次輸入八個點
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:7.92mb
    • 提供者:Emuil
  1. xapp208

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  2. xilinx 基于查找表方法实现的IDCT的verilog源码
  3. 所属分类:图形图象

    • 发布日期:2008-10-13
    • 文件大小:8.58kb
    • 提供者:lee
  1. IDCT

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  2. 用verilog HDL语言编写的IDCT程序,可以计算8*8的整形数矩阵,用ISE 9.1i编译通过-Using verilog HDL language of the IDCT program can calculate the number of 8* 8 matrix of plastic, with ISE 9.1i compiled by
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:467.85kb
    • 提供者:阿文
  1. mpeg2_idct_hw

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  2. 2-D的DCT/IDCT在軟硬體上的verilog code-dct/idct source code for soc
  3. 所属分类:mpeg mp3

    • 发布日期:2017-05-28
    • 文件大小:10.3mb
    • 提供者:陳伯綸
  1. DCTPROGRAM.ZIP

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  2. it is verilog code for two dimentional dct
  3. 所属分类:Compress-Decompress algrithms

    • 发布日期:2016-06-14
    • 文件大小:17.68kb
    • 提供者:suhu
  1. DCT_IDCT

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  2. verilog code for DCT and IDCT (JPEG)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:61.94kb
    • 提供者:Dang Tien Dat
  1. DCT_IDCT

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  2. H264/AVS中的离散余弦变换DCT以及反离散余弦变换IDCT的Verilog代码-H264/AVS the discrete cosine transform and inverse discrete cosine transform DCT IDCT of Verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:27.69kb
    • 提供者:李柏祥
  1. dctidct

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  2. dct and idct code for verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:2.22kb
    • 提供者:kartik
  1. Axi_mux

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  2. The elements come from the necessity of creating generic modules, in the verification phase, for this widely used protocol. These primitives are presented as a not compiled library written in SystemC where interfaces are the core of the lib
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:41.19kb
    • 提供者:Paul Stephen
  1. xapp208

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  2. xilinx 基于查找表方法实现的IDCT的verilog源码-Xilinx LUT-based method to achieve the IDCT of the Verilog source code
  3. 所属分类:Graph program

    • 发布日期:2017-04-03
    • 文件大小:8.58kb
    • 提供者:ening
  1. IDCT

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  2. HEVC是正在研发的新一代视频编码标准。 本文面向HDTV应用,设计兼容HEVC标准的两位整数IDCT电路, 通过对IDCT的特点进行分析,完成了电路的架构设计, 采用较为节省面积的做法和流水线结构,并进行VerilogHDL代码设计-High Efficiency Video Coding(HEVC) is the currently developing video standard. In this article, a novel pipelined 2-D IDCT architect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:4.94kb
    • 提供者:毕翔宇
  1. DCT_IDCT

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  2. DCT and Idct with vhdl and verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:
    • 文件大小:61kb
    • 提供者:lovers2015
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