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  1. RTL

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  2. 256位有符号整数乘法器，个人学习时编写，接口为IPBUS，用verilog语言编写-256-bit signed integer multiplier, when writing individual learning, the interface IPBUS, with verilog language

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-03
    • 文件大小：2918
    • 提供者：毛

  1. IPBus

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  2. IP-Bus emu system by Vitaliy Koutchaev

  3. 所属分类：软件工程

    • 发布日期：2017-12-14
    • 文件大小：23552
    • 提供者：craxycat
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