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搜索资源列表

  1. MY_CTL

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  2. -- Simple Robot Control Program -------------------------------------------------------------------------- -- Left is left IR sensor - 1=object to left -- Right is rigth IR sensor - 1=object to right -- Lmotor_dir 1=forward 0=reverse -- Rmo
  3. 所属分类:Other systems

    • 发布日期:2017-03-29
    • 文件大小:1.54kb
    • 提供者:yu
  1. IR

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  2. 红外线接收: 使用任何遥控器(电视、空调等),对准开发板的红外线接收管,按下遥控器的任何按钮,LED0 会按照红外线码进行闪烁。 -Infrared receiver: the use of any remote control (TV, air conditioning, etc.), targeting the development board infrared receiver tube, press any button on the remote control, LED0 wi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:76.94kb
    • 提供者:panda
  1. cpu

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  2. 设计一个简化的处理器(字长8位),并使其与内存MEM连接,协调工作。用VHDL以RTL风格描述。该处理器当前执行的指令存放在指令寄存器IR中。处理器的指令仅算逻指令和访问内存指令)。-Design a simplified processor (8-bit word length), and connect it with the memory MEM, and coordination. Described with VHDL in RTL style. The processor is c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.52mb
    • 提供者:jinxf
  1. rc5

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  2. RC5 Decoder VHDL Source Code Ir Remocon Code Decoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:3.54kb
    • 提供者:damorzio
  1. CPU-with-VHDL-16-32

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  2. 在quartus中运行的32位指令集的16位CPU程序,模块化设计,包括MBR, BR, MR, ACC, MAR, PC, IR, CU, ROM, RAM, ALU等模块-In the the quartus run 32 16-bit CPU instruction set procedures, modular design, including the MBR, BR, MR, the ACC, the MAR, the PC, the IR CU, the ROM, RAM, ALU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.58mb
    • 提供者:
  1. vhdl-pipeline-mips0

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  2. MIPS CPU WITH PIPELINE procesador MIPS-FZA -- Autor: mahdi ahmadi -- Email: mahdi@fza.ir -- mahdifza@yahoo.com -- -- Version: 1.0
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:22.77kb
    • 提供者:mahdi
  1. ir

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  2. 在DE2-115板子上的IR接受器的控制器(给予VHDL语言)!已在板子上调试通过,可以直接使用!-DE2-115 board IR receiver controller (given VHDL language)! Through debugging on the board, can be used directly!
  3. 所属分类:VHDL编程

    • 发布日期:2013-12-07
    • 文件大小:5.62mb
    • 提供者:夏明
  1. vhdl__example_fza.ir

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  2. useful vhdl example contain adder-mux-counter-ram-shifter-rom-flipflop-useful vhdl example contain adder-mux-counter-ram-shifter-rom-flipflop...
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:22kb
    • 提供者:mahdi
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