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搜索资源列表

  1. EAUserGuide

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  2. 視覺化的塑模工具,Enterprise Architect這套工具,有支援圖形轉換成10種以上的程式語言(Actionscr ipt、Ada、C and C++、C#、Java、Delphi、Verilog、PHP、VHDL、Python、System、C、VB.Net、Visual Basic)與DDL(SQL scr ipt)-Visual modeling tool, Enterprise Architect set of tools, support for graphics into
  3. 所属分类:software engineering

    • 发布日期:2016-08-25
    • 文件大小:19.6mb
    • 提供者:Yu-Kuang CHUNG
  1. StopWatch

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  2. 用C#写的跑表,用于学习Timer控件和C#下的stopwatch类,在VS.net 2005下运行通过.-Using C# to write the stopwatch for the study and Timer controls and C# under the stopwatch class, VS.net 2005 in the run through.
  3. 所属分类:.net

    • 发布日期:2016-01-25
    • 文件大小:37.94kb
    • 提供者:weixin
  1. ethernet_tri_mode

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  2. Its an verilog coded ether net tri mode project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.05mb
    • 提供者:apranav
  1. Verilog

    0下载:
  2. 在Verilog中有两种类型的赋值语句:连续赋值和过程赋值。赋值表达式由三个部分组成:左值、赋值运算符(=或<=)和右值。右值可以是任何类型的数据,包括net型和register型;但对连续赋值,左值必须是net类型的数据;而过程赋值,左值必须是register类型的数据。下面将作详细描述-There are two types in the Verilog assignment statement: continuous assignment and process assignment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:4.91kb
    • 提供者:林林
  1. (www.entrance-exam.net)-GEN.-APP

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  2. verilog hdl code for speed control of dc motor
  3. 所属分类:VHDL-FPGA-Verilog

  1. key

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  2. PS2键盘协议代码 verilog,可以在ISE上跑,约束条件:NET"F50M" LOC="B8" NET"ps2_clk" LOC="R12" NET"ps2_data" LOC="P11" NET"rst" LOC="H13" NET"seg[6]" LOC="L18" NET"seg[5]" LOC="F18" NET"seg[4]" LOC="D17" NET"seg[3]" LOC="D16" NET"seg[2]" LOC="G14"
  3. 所属分类:source in ebook

    • 发布日期:2017-04-16
    • 文件大小:32.9kb
    • 提供者:刘云
  1. Beautiful Restful API in ASP.Net Core

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  2. restfull api for the team to beryfy what is the p[robme
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-29
    • 文件大小:34kb
    • 提供者:iad
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