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搜索资源列表

  1. router

    1下载:
  2. VHDL router16通路选择器 基于实际模型的设计
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:2.41kb
    • 提供者:wuxiao
  1. router_routing

    0下载:
  2. 片上网络NOC基于fpga实现的,routing模块。-NOC-chip networks realized fpga-based, routing module.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.01kb
    • 提供者:巴音
  1. netfpga_base_beta_1_2_5_2_CentOS4.tar

    0下载:
  2. centOS4与netfpga的协同工程文件,可以提高router的处理速度-centOS4 collaborative projects with netfpga documents, can improve processing speed router
  3. 所属分类:Other systems

    • 发布日期:2017-05-14
    • 文件大小:3.21mb
    • 提供者:jingjie
  1. netfpga_rcp_router_1_0_0.tar

    0下载:
  2. 以NetFPGA为开发平台的路由器,可以在开发板上综合为真正的路由器!-NetFPGA a platform for the development of the router, can be integrated in the development of on-board router for real!
  3. 所属分类:Other systems

    • 发布日期:2017-04-10
    • 文件大小:1.76mb
    • 提供者:jingjie
  1. Rocket

    0下载:
  2. 很好的高速口的设计资料,很好的高速口的设计资料 很好的高速口的设计资料-In design of large-scale access convergence router(hereafter referred to ACR) forwarding engine, the Xilinx Virtex-4 FPGA!s RocketI/O r multi-gigabit transceiver is used to satisfy the need of high speed and st
  3. 所属分类:matlab

    • 发布日期:2017-03-27
    • 文件大小:265.86kb
    • 提供者:guoguo
  1. in_combine

    0下载:
  2. 高速路由器中,四路2.5Gbps数据合并成一路10Gbps数据。-High-speed router, four 2.5Gbps data merged into the way 10Gbps data.
  3. 所属分类:Other systems

    • 发布日期:2017-03-29
    • 文件大小:3.24kb
    • 提供者:gluttoni
  1. fifo

    0下载:
  2. This VHDL code for FIFO that is used in a NOC router-This is VHDL code for FIFO that is used in a NOC router
  3. 所属分类:易语言编程

    • 发布日期:2013-04-10
    • 文件大小:608byte
    • 提供者:Anish Goel
  1. router

    0下载:
  2. This VHDL code for router used in FPGA based system -This is VHDL code for router used in FPGA based system
  3. 所属分类:ELanguage

    • 发布日期:2017-12-09
    • 文件大小:1007byte
    • 提供者:Anish Goel
  1. intf_wrapper

    0下载:
  2. This a vhdl code for router code for testing write and read transfers code-This is a vhdl code for router code for testing write and read transfers code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:672byte
    • 提供者:usha
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