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搜索资源列表

  1. RS232串口通信协议

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  2. RS232串口通信协议,verilog实现,通过FPGA完全调通。,RS232 serial communication protocol, verilog achieved entirely through the FPGA transfer pass.
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:3.45kb
    • 提供者:dingsheng
  1. rs232

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  2. 完整的RS232 Verilog源代码,支持波特率可调,支持调试命令,配合串口调试工具,可作为FPGA开发中的调试平台。-Full RS232 Verilog source code, support for baud rate is adjustable to support debugging command, with the serial debugging tools can be used as the debugging FPGA development platform.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:13.04kb
    • 提供者:弘历
  1. RS232_control

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  2. verilog RS232信号解码模块。为在FPGA中的verilog代码。-verilog RS232 control module。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:10.07kb
    • 提供者:haohuifeng
  1. rs232

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  2. 用verilog实现的RS232时序控制,完整可以使用的-RS232 verilog implementation with timing control, you can use the full
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.86mb
    • 提供者:wangjinghui
  1. RS232(verilog)

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  2. 串口RS232通信程序,包括对串口通信原理的说明。-RS232 serial communication program, including a descr iption of the principles of serial communication.
  3. 所属分类:Com Port

    • 发布日期:2017-03-28
    • 文件大小:169.93kb
    • 提供者:邓民明
  1. FPGA-RS232-verilog

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  2. fpga上的串口驱动程序,包括接收主机来的数据(deserial)和发送由FPGA产生的数据(serial).该程序的调试需要借助串口调试助手-serial port driver on the fpga, including the receiving host to the data (deserial) and send the data generated by the FPGA (serial) to pc. The program needs the serial debug deb
  3. 所属分类:Com Port

    • 发布日期:2017-03-23
    • 文件大小:488.83kb
    • 提供者:yvaine
  1. URAT

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  2. Verilog硬件描述语言,RS232串口发送接收程序-Verilog hardware descr iption language, RS232 serial port send and receive program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.45kb
    • 提供者:zhaoyf
  1. RS232_pro

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  2. RS232 verilog coding 全参数化设计 可以自己设定波特率 时钟频率等 完全FPGA实现调通-RS232 verilog coding the entire parametric design can set the baud rate clock frequency of FPGA to achieve complete transfer pass
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.56kb
    • 提供者:dinsh
  1. RS232

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  2. 很好用的串口通讯程序,已经通过验证,用Verilog语言编写的放心使用了!-Good use of serial communication program has been validated using Verilog language used in the rest assured!
  3. 所属分类:Com Port

    • 发布日期:2017-04-23
    • 文件大小:52.7kb
    • 提供者:宋振丰
  1. cw3

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  2. serial port rs232 in verilog source code
  3. 所属分类:Parallel Port

    • 发布日期:2017-04-10
    • 文件大小:1.45kb
    • 提供者:malkanin
  1. async_transmitter

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  2. 该程序为RS232串口通信的VERILOG程序,在FPGA上已通过验证,在测试范围内误码率为0-The program for the RS232 serial port communications VERILOG procedures, the FPGA has been validated in the test range of bit error rate is 0
  3. 所属分类:Communication

    • 发布日期:2017-03-26
    • 文件大小:996byte
    • 提供者:su
  1. RS232_project

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  2. 串口通讯 rs232 verilog程序,一次接受传送8bits-rs232 verilog project,reciver or trancimiter 8 bits onece
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:2.19kb
    • 提供者:王翰林
  1. c_FPGA

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  2. RS232设计,硬件测试通过,VERILOG实现的,比较好的哦-RS232 design, hardware test, VERILOG realized, oh good
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-10
    • 文件大小:1.19mb
    • 提供者:洪依
  1. RS232

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  2. RS232_串口通信的发送端verilog源程序代码-RS232_ serial communication sender verilog source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.85kb
    • 提供者:咕嘟大树
  1. uart

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  2. RS232控制分频,实现占空比和频率可以控制的分频器-verilog RS232
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:78.28kb
    • 提供者:cuiqiang
  1. rs232-Quartus

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  2. 利用verilog語法,來達成串口rs232的功能-Using verilog syntax, to achieve the functions of serial rs232
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:468.77kb
    • 提供者:張三
  1. RS232

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  2. 实现FPGA的RS232串行通信,采用verilog语言编写,下载到芯片上就可以使用-FPGA implementation of the RS232 serial communication, using verilog language, can be downloaded to the chip using
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:586.4kb
    • 提供者:shineson
  1. rs232

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  2. 本设计是PC和FPGA的串口通信的程序,用的是VERILOG语言,调试成功,用户可根据自己的项目稍作改动。-The design is a PC and the FPGA' s serial communication procedures, using a VERILOG language, debugged, the user can make a little change according to their own projects.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.42kb
    • 提供者:陆景鹏
  1. RS232

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  2. It s combination logic for UART. edited in verilog-HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:648byte
    • 提供者:kim
  1. RS232

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  2. It s combination logic for UART. Edited in verilog-HDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:5.29kb
    • 提供者:kim
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