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搜索资源列表

  1. i2c总线的vhdl实现和vxworks的文件系统.rar

    1下载:
  2. i2c总线的vhdl实现和vxworks的文件系统,i2c bus VHDL realization and VxWorks file system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:15.86kb
    • 提供者:李建平
  1. file_io

    1下载:
  2. 读写硬盘文件的VHDL仿真例程,该例程能够帮助FPGA设计人员读取硬盘的数据文件输入仿真环境,并且将仿真后的数据存入硬盘-test bench for reading and writing disk files
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:806byte
    • 提供者:season Li
  1. ddfs

    0下载:
  2. 直接数字频率合成器,整个工程文件都在,仿真也有,直接就能用。-Direct digital frequency synthesizer, the entire project file are in the simulation is also directly be able to use.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:466.74kb
    • 提供者:
  1. ldpc7_3

    1下载:
  2. the attached file consists of LDPC code (7,3). this code can be easily implemented on fpga kit(sparten-3)
  3. 所属分类:Communication

    • 发布日期:
    • 文件大小:2.01kb
    • 提供者:babi
  1. vhdl

    0下载:
  2. vhdl file u can use it
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.94mb
    • 提供者:kitti_kkc
  1. keyb

    0下载:
  2. this a fpga sparttan 3e based project in which i have made a game based on vga interface . this file is the supporting file for keyboard interface and it also included a intro.vhdl file required for the startup animation file.-this is a fpga spa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:1.63kb
    • 提供者:yasir
  1. DC_ASSIGN

    0下载:
  2. counter clock vhdl file for useful to dc compilier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:38.7kb
    • 提供者:ns
  1. 001.File.Joiner.and.Splitter.v4.0.5.0-RedT_nled.z

    0下载:
  2. test of vhdl 74 code
  3. 所属分类:Windows Develop

    • 发布日期:2017-05-14
    • 文件大小:3.33mb
    • 提供者:kang
  1. SRF05

    0下载:
  2. VHDL: file to manage a sonar SRF05
  3. 所属分类:Windows Develop

    • 发布日期:2017-03-31
    • 文件大小:3.84kb
    • 提供者:pumaju
  1. DWT-VHDL

    0下载:
  2. 小波变换的VHDL代码,内带正变换逆变换的测试文件。-Wavelet transform VHDL code, with a positive transformation within the inverse transform of the test file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-05-16
    • 文件大小:17.56kb
    • 提供者:Janee
  1. ofdm_latest.tar

    0下载:
  2. it is ofdm modem vhdl file
  3. 所属分类:Modem program

    • 发布日期:2017-05-16
    • 文件大小:4.07mb
    • 提供者:prasad
  1. RamFifoVHDL

    0下载:
  2. Ram Fifo Core VHDL file
  3. 所属分类:VHDL-FPGA-Verilog

  1. Mux81a

    0下载:
  2. 8选1数据选择器 VHDL文件 数电很有用的-8 to 1 Data Selector VHDL file useful for digital circuits
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:13.28kb
    • 提供者:bill
  1. crc

    0下载:
  2. 本代码是CRC循环冗余校验实例,包含顶层原理图文件,十分直观-The CRC is cyclic redundancy check code examples, including the top-level schematic file, very intuitive
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:438.54kb
    • 提供者:renjiale
  1. sin_cos_ROM.vhdl

    0下载:
  2. FPGA内部sin_ROM.VHDL和COS_ROM.VHDL文件-FPGA internal sin_ROM.VHDL and COS_ROM.VHDL file
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:2.75kb
    • 提供者:zhao
  1. RC6-block-cipher-using-VHDL

    1下载:
  2. VHDL implementation of RC6 encryption algorithm Test file represent applying all zero input and all zero key note that result is correct but bytes positions are swapped
  3. 所属分类:VHDL编程

    • 发布日期:2013-04-01
    • 文件大小:53.77kb
    • 提供者:waleed
  1. HASH-code-implementation-using-VHDL

    0下载:
  2. implementation for Secure Hash Algorithm 1 SHA-1 in vhdl language contain no test file.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:13.54kb
    • 提供者:waleed
  1. vhdl-ad9910

    1下载:
  2. ad9910 DDS板 VHDL源代码,在Cyclone II FPGA上调试通过,主要文件说明: Filename Function ----------------------------------------------------- dds_controller.vhd top entity, opcode decoding ddslib.vhd configuration,opcode definition dds_serial.vhd parallel to s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:90.66kb
    • 提供者:bin
  1. aes-vhdl

    0下载:
  2. this file contains vhdl code for aes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:117.24kb
    • 提供者:baby
  1. VHDL-file-to-generate-stimulous-from-a-file-and.r

    0下载:
  2. VHDL file to generate stimulous from a file and : feed it to a testbench-VHDL file to generate stimulous from a file and : feed it to a testbench
  3. 所属分类:Project Design

    • 发布日期:2017-10-31
    • 文件大小:1.63kb
    • 提供者:Mozhi
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