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  1. Addr_Generator

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  2. 其中start是开始信号,上升沿启动控制单元;CLK是工作时钟;CtrlAddr是读取控制字时的地址;CtrlData是读取的控制字;Reading是读信号;EOP是本次AD采样完成信号,只有当AD1和AD2均完成后EOP才为高;EN是允许信号,启动分频器、地址发生器;N是分频系数;Addr1和Addr2分别是AD1和AD2数据存储的起始地址;NUM1和NUM2分别是采样点数。 控制字分别表示分频系数为2,AD1起始地址为1,采样点数5,AD2起始地址为3,采样点数为4。 -Where
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-26
    • 文件大小:1024
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