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  1. celery

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  2. 一个模10范围0-9的计数器，要求有输入端时钟clk、清零clr，4位输出； 还有一个模60范围0-59计数器，要求有输入端clk、clr、使能端en，分别以4位输出个位0-9与十位0-5，输出进位co-a funny counter

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-16
    • 文件大小：299193
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