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  1. counter2b

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  2. 基于vhdl完成4位计数器功能的实现,并基于此程序完成16位加法器程序的编写,内附testbench,测试成功。-Based on the vhdl completed four counter function to achieve, and the completion of a 16-bit adder program written based on this program, enclosing testbench, the test is successful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:39810
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