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  1. detect_3

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  2. 任意3比特序列数据检测,只要输入任意3比特的数据序列,检测到之后,使输出置高为一。-Detection of any sequence data of 3 bits, as long as the input data sequence of three arbitrary bits, after the detection, the output is set high one.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:845
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